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参数资料
| 型号： | MC68HC705T16B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | PLASTIC, SDIP-56 |
| 文件页数： | 110/128页 |
| 文件大小： | 734K |
| 代理商： | MC68HC705T16B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页当前第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MOTOROLA
9-12
MC68HC05T16
ON-SCREEN DISPLAY
9
9.4.3
Row Horizontal Position Register
SHDW - Shadow/border select
1 (set)
–
Shadow feature is selected if RiBE is enabled. See Section 9.4.1.
0 (clear) –
Border feature is selected if RiBE is disabled. See Section 9.4.1.
HP6 to HP0 - Horizontal Position
Each (HP6-HP0) step shifts the horizontal position of all four rows by 4 dots. The reference point
of shift is the leading edge of horizontal yback signal. Note that there is only one Row Horizontal
Position register for all 4 row buffers, therefore all rows will have the same horizontal start point.
If (HP6-HP0) is so programmed that part of the row display goes beyond the beginning of a
horizontal yback signal, display wrap-around occurs. That is, all lines of the row display will have
all dots before the nth horizontal yback displayed on one line and all remaining dots after the nth
horizontal yback, along with all dots of next line before the (n+1)th horizontal yback displayed
on the next line.
9.4.4
Row Control Register 1
RiINTE - Row interrupt
1 (set)
–
Row interrupt enabled.
0 (clear) –
Row interrupt disabled.
Enable/disable interrupt of row i if one of the following conditions occur:
1) the part of the row i display which is not overridden by other overlapping
rows has been completed, or
2) the part of the row i display which does not overlap vertical retrace period
has been completed.
Note that for the case where row i is completely overlapped by other rows, row i display has never
really happened, that is, terminated upon its commencement, row i interrupt will never occur.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
$28
SHDW
HP6
HP5
HP4
HP3
HP2
HP1
HP0
0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
$29
R3INTE
R2INTE
R1INTE
R0INTE
R3EN
R2EN
R1EN
R0EN
0000 0000
TPG
80
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC05T16B | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| MC68HC705V8CFU | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP64 |
| MC68HC705V8B | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| MC68HC705V8FN | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC68 |
| MC68HC705V8CFN | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC68 |
相关代理商/技术参数 |
参数描述 |
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