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参数资料
| 型号： | MC9328MX1DVM15R2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 26/100页 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MX 150MHZ 256-MAPBGA |
| 标准包装： | 1,000 |
| 系列： | i.MX1 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 150MHz |
| 连通性： | EBI/EMI，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 110 |
| 程序存储器类型： | ROMless |
| 电压 - 电源 (Vcc/Vdd)： | 1.7 V ~ 3.3 V |
| 振荡器型： | 外部 |
| 工作温度： | -30°C ~ 70°C |
| 封装/外壳： | 256-MAPBGA |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页
Functional Description and Application Information
MC9328MX1 Technical Data, Rev. 7
Freescale Semiconductor
31
4.4.2.1
WAIT Read Cycle without DMA
Figure 6. WAIT Read Cycle without DMA
Table 13. WAIT Read Cycle without DMA: WSC = 111111, DTACK_SEL=1, HCLK=96MHz
Number
Characteristic
3.0 ± 0.3 V
Unit
Minimum
Maximum
1OE and EB assertion time
See note 2
–
ns
2CS5 pulse width
3T
–
ns
3OE negated to address inactive
56.81
–
ns
4
Wait asserted after OE asserted
–
1020T
ns
5
Wait asserted to OE negated
2T+2.2
3T+7.17
ns
6
Data hold timing after OE negated
T-1.86
–
ns
7
Data ready after wait asserted
0
T
ns
8
OE negated to CS negated
1.5T+0.24
1.5T+0.85
ns
9
OE negated after EB negated
0.5
1.5
ns
10
Become low after CS5 asserted
0
1019T
ns
11
Wait pulse width
1T
1020T
ns
Note:
1. T is the system clock period. (For 96 MHz system clock, T=10.42 ns)
2. OE and EB assertion time is programmable by OEA bit in CS5L register. EB assertion in read cycle will occur only when
EBC bit in CS5L register is clear.
3. Address becomes valid and CS asserts at the start of read access cycle.
4. The external wait input requirement is eliminated when CS5 is programmed to use internal wait state.
WAIT
Address
EB
CS5
OE
DATABUS
programmable
min 0ns
1
2
3
8
9
5
6
7
11
10
4
X1)
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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