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参数资料
| 型号： | MC9328MX1DVM15R2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 64/100页 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MX 150MHZ 256-MAPBGA |
| 标准包装： | 1,000 |
| 系列： | i.MX1 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 150MHz |
| 连通性： | EBI/EMI，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 110 |
| 程序存储器类型： | ROMless |
| 电压 - 电源 (Vcc/Vdd)： | 1.7 V ~ 3.3 V |
| 振荡器型： | 外部 |
| 工作温度： | -30°C ~ 70°C |
| 封装/外壳： | 256-MAPBGA |
| 包装： | 带卷 (TR) |
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Functional Description and Application Information
MC9328MX1 Technical Data, Rev. 7
66
Freescale Semiconductor
Figure 44. SPI SCLK Timing Diagram
4.9
LCD Controller
This section includes timing diagrams for the LCD controller. For detailed timing diagrams of the LCD
controller with various display configurations, refer to the LCD controller chapter of the MC9328MX1
Reference Manual
.
Figure 45. SCLK to LD Timing Diagram
Ref No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
1
SPI_RDY to SS output low
2T1
1 T = CSPI system clock period (PERCLK2).
–ns
2SS output low to first SCLK edge
3 Tsclk2
2 Tsclk = Period of SCLK.
–ns
3
Last SCLK edge to SS output high
2 Tsclk
–
ns
4SS output high to SPI_RDY low
0
–
ns
5SS output pulse width
Tsclk + WAIT 3
3 WAIT = Number of bit clocks (SCLK) or 32.768 kHz clocks per Sample Period Control Register.
–ns
6SS input low to first SCLK edge
T
–
ns
7SS input pulse width
T
–
ns
Table 25. Timing Parameter Table for SPI SCLK
Ref No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
8
SCLK frequency
0
10
MHz
9
SCLK pulse width
100
–
ns
SCLK
8
9
1
LSCLK
LD[15:0]
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PDF描述 |
|---|---|
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| VE-23W-CU | CONVERTER MOD DC/DC 5.5V 200W |
相关代理商/技术参数 |
参数描述 |
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