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参数资料
| 型号： | MC9328MX1VH20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 200 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | 14 X 14 MM, 1.30 MM HEIGHT, 0.80 MM PITCH, MAPBGA-256 |
| 文件页数： | 46/86页 |
| 文件大小： | 1465K |
| 代理商： | MC9328MX1VH20 |
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50
MC9328MX1 Advance Information
MOTOROLA
Specifications
Figure 34. SPI Interface Timing Diagram Using Motorola MC13180
3.12 SPI Timing Diagrams
To use the internal transmit (TX) and receive (RX) data FIFOs when the SPI 1 module is configured as a
master, two control signals are used for data transfer rate control: the SS signal (output) and the SPI_RDY
signal (input). The SPI 1 Sample Period Control Register (PERIODREG1) and the SPI 2 Sample Period
Control Register (PERIODREG2) can also be programmed to a fixed data transfer rate for either SPI 1 or
SPI 2. When the SPI 1 module is configured as a slave, the user can configure the SPI 1 Control Register
(CONTROLREG1) to match the external SPI master’s timing. In this configuration, SS becomes an input
signal, and is used to latch data into or load data out to the internal data shift registers, as well as to
increment the data FIFO.
Table 19. SPI Interface Timing Parameter Table Using Motorola MC13180
Ref
No.
Parameter
Minimum
Maximum
Unit
1
SPI_EN setup time relative to rising edge of SPI_CLK
15
—
ns
2
Transmit data delay time relative to rising edge of SPI_CLK
0
15
ns
3
Transmit data hold time relative to rising edge of SPI_EN
0
15
ns
4
SPI_CLK rise time
0
25
ns
5
SPI_CLK fall time
0
25
ns
6
SPI_EN hold time relative to falling edge of SPI_CLK
15
—
ns
7
Receive data setup time relative to falling edge of SPI_CLK1
1.
The SPI_CLK clock frequency and duty cycle, setup and hold times of receive data can be set by
programming SPI_Control (0x00216138) register together with system clock.
15
—
ns
8
Receive data hold time relative to falling edge of SPI_CLK1
15
—
ns
9
SPI_CLK frequency, 50% duty cycle required1
—20
MHz
SPI_EN (BT11)
SPI_DATA_OUT (BT12)
SPI CLK (BT13)
SPI_DATA_IN (BT4)
1
7
4
5
8
2
3
6
9
相关PDF资料 |
PDF描述 |
|---|---|
| MC9328MX1VH15 | 150 MHz, MICROPROCESSOR, PBGA256 |
| MC9328MX1VM15 | 32-BIT, 150 MHz, RISC PROCESSOR, PBGA256 |
| MC9328MX1CVM15R2 | 32-BIT, 150 MHz, RISC PROCESSOR, PBGA256 |
| MC9328MX1VM20R2 | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA256 |
| MC9328MX1CVM15 | 32-BIT, 150 MHz, RISC PROCESSOR, PBGA256 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| MC9328MX1VM20 | 功能描述:处理器 - 专门应用 DRAGONBALL MX1 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MC9328MX1VM20R2 | 功能描述:处理器 - 专门应用 DRAGONBALL MX1 RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| MC9328MX21 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:i.MX family of microprocessors |
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