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参数资料
| 型号： | MCIMX513DJM8C |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA529 |
| 封装： | 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-529 |
| 文件页数： | 179/198页 |
| 文件大小： | 3041K |
| 代理商： | MCIMX513DJM8C |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页当前第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页
Electrical Characteristics
i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 4
Freescale Semiconductor
81
4.7.6.2
High-Speed Mode Timing Parameters
characteristics.
Figure 47. High-Speed Mode Timing
Table 76. HS-I2C High-Speed Mode Timing Parameters
ID
Parameter
High-Speed Mode
Unit
Min
Max
IC1
SCLH cycle time
10
3.4
MHz
IC2
Setup time (repeated) START condition
160
—
ns
IC3
Hold time (repeated) START condition
160
—
ns
IC4
LOW Period of the SCLH Clock
160
—
ns
IC5
HIGH Period of SCLH Clock
60
—
ns
IC6
Data set-up time
10
—
ns
IC7
Data hold time
01
1 A device must internally provide a hold time of at least 300 ns for SDAH signal in order to bridge the undefined region of the
falling edge of SCLH.
70
ns
IC8
Rise time of SCLH
10
40
ns
IC9
Rise time of SCLH signal after a repeated START condition and after an acknowledge bit
10
80
ns
IC10 Fall time of SCLH signal
10
40
ns
IC11 Rise time of SDAH signal
10
80
ns
IC12 Fall time of SDAH signal
10
80
ns
IC13 Set-up time for STOP condition
160
—
ns
IC14 Capacitive load for each bus line (Cb)
—
100
pF
IC11
IC12
IC3
IC6
IC7
IC2
IC13
IC4
IC9
IC5
IC10
START
STOP
START
SDAH
SCLH
IC1
IC8
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PDF描述 |
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