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参数资料
| 型号： | MCIMX537CVV8C |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 800 MHz, RISC PROCESSOR, PBGA529 |
| 封装： | 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, TEPBGA-529 |
| 文件页数： | 8/172页 |
| 文件大小： | 4562K |
| 代理商： | MCIMX537CVV8C |
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Electrical Characteristics
i.MX53 Applications Processors for Industrial Products, Rev. 3
Freescale Semiconductor
105
4.7.9
LVDS Display Bridge (LDB) Module Parameters
The LVDS interface complies with TIA/EIA 644-A standard. For more details, see TIA/EIA STANDARD
644-A, “Electrical Characteristics of Low Voltage Differential Signaling (LVDS) Interface Circuits”.
4.7.10
One-Wire (OWIRE) Timing Parameters
Figure 58. Reset and Presence Pulses (RPP) Timing Diagram
7Display control down for read
DISP_DOWN is predefined in REGISTER.
8Display control up for write
DISP_UP is predefined in REGISTER.
Table 65. RPP Sequence Delay Comparisons Timing Parameters
ID
Parameters
Symbol
Min
Typ
Max
Unit
OW1
Reset Time Low
tRSTL
480
511
—1
1 In order not to mask signaling by other devices on the 1-Wire bus, t
RSTL + tR should always be less than 960 s.
s
OW2
Presence Detect High
tPDH
15
—
60
s
OW3
Presence Detect Low
tPDL
60
—
240
s
OW4
Reset Time High
(includes recovery time)
tRSTH
480
512
—
s
Tdicdrw
1
2
---T
DI_CLK
ceil
×
2
DISP_DOWN_#
×
DI_CLK_PERIOD
--------------------------------------------------
=
Tdicuw
1
2
---T
DI_CLK
ceil
×
2DISP_UP_#
×
DI_CLK_PERIOD
----------------------------------------------
=
One-Wire bus
One Wire Device Tx
“Presence Pulse”
(BATT_LINE)
One-WIRE Tx
“Reset Pulse”
OW1
OW2
OW3
OW4
tR
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