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参数资料
| 型号： | MD83C154CXXX-16P883D |
| 厂商： | TEMIC SEMICONDUCTORS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| 文件页数： | 33/242页 |
| 文件大小： | 61013K |
| 代理商： | MD83C154CXXX-16P883D |
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ATmega165A/PA/325A/PA/3250A/PA/645A/P/6450A/P [DATASHEET]
8285E–AVR–02/2013
Depending on the mode of operation used, the counter is cleared, incremented, or decremented at each timer
clock (clk
T2). clkT2 can be generated from an external or internal clock source, selected by the Clock Select bits
(CS2[2:0]). When no clock source is selected (CS2[2:0] = 0) the timer is stopped. However, the TCNT2 value can
be accessed by the CPU, regardless of whether clk
T2 is present or not. A CPU write overrides (has priority over) all
counter clear or count operations.
The counting sequence is determined by the setting of the WGM21 and WGM20 bits located in the Timer/Counter
Control Register (TCCR2A). There are close connections between how the counter behaves (counts) and how
waveforms are generated on the Output Compare output OC2A. For more details about advanced counting
sequences and waveform generation, see ”Modes of Operation” on page 130.
The Timer/Counter Overflow Flag (TOV2) is set according to the mode of operation selected by the WGM2[1:0]
bits. TOV2 can be used for generating a CPU interrupt.
18.5
Output Compare Unit
The 8-bit comparator continuously compares TCNT2 with the Output Compare Register (OCR2A). Whenever
TCNT2 equals OCR2A, the comparator signals a match. A match will set the Output Compare Flag (OCF2A) at the
next timer clock cycle. If enabled (OCIE2A = 1), the Output Compare Flag generates an Output Compare interrupt.
The OCF2A Flag is automatically cleared when the interrupt is executed. Alternatively, the OCF2A Flag can be
cleared by software by writing a logical one to its I/O bit location. The Waveform Generator uses the match signal
to generate an output according to operating mode set by the WGM2[1:0] bits and Compare Output mode
(COM2A[1:0]) bits. The max and bottom signals are used by the Waveform Generator for handling the special
cases of the extreme values in some modes of operation (”Modes of Operation” on page 130).
Figure 18-3 shows a block diagram of the Output Compare unit.
Figure 18-3. Output Compare Unit, block diagram.
The OCR2A Register is double buffered when using any of the Pulse Width Modulation (PWM) modes. For the
Normal and Clear Timer on Compare (CTC) modes of operation, the double buffering is disabled. The double buff-
ering synchronizes the update of the OCR2A Compare Register to either top or bottom of the counting sequence.
The synchronization prevents the occurrence of odd-length, non-symmetrical PWM pulses, thereby making the
output glitch-free.
The OCR2A Register access may seem complex, but this is not case. When the double buffering is enabled, the
CPU has access to the OCR2A Buffer Register, and if double buffering is disabled the CPU will access the OCR2A
directly.
OCFnx (Int.Req.)
= (8-bit Comparator )
OCRnx
OCnx
DATA BUS
TCNTn
WGMn1:0
Waveform Generator
top
FOCn
COMnx1:0
bottom
相关PDF资料 |
PDF描述 |
|---|---|
| MR83C154CXXX-L16P883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
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参数描述 |
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