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参数资料
| 型号： | MN101CP54CAL |
| 厂商： | PANASONIC CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, 0.65 MM PITCH, PLASTIC, LQFP-80 |
| 文件页数： | 395/544页 |
| 文件大小： | 2900K |
| 代理商： | MN101CP54CAL |
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Chapter 14 LCD Functions
XIV - 12 Operation
At reset, common pins and segment pins become high impedance.
Therefore, when reset input from external sources is long, there could be some adverse
effects such as blinks of the LCD display.
14-3
Operation
14-3-1
Operation
The LCD driver is capable of static display and dynamic display (1/2 duty 1/2 bias, 1/3 duty 1/3bias, 1/4
duty 1/3 bias) through the segment output pins (SEG0 to SEG31) and the common output pins (COM0 to
COM3).
nThe LCD driver circuit operation
The LCD driver circuit generates the timing siginals, which are necessary for controling 1/2 duty, 1/3 duty,
1/4 duty and static, at the timing control circuit, based on the LCD clock divided by the prescaler, and
supplies them to the common driver and the multiplexer.
The common driver outputs the common signals which are necessary for the LCD display, based on the
voltage from the LCD power supply. When the LCD is OFF VSS is output and the potential difference
between the LCD electrodes becomes 0 V.
The multiplexer selects the segment output latched data in response to the signal from the timing control
circuit and supplies it to the segment driver. The segment driver converts the content of the segment
output latch into the signals, which is capable of driving the LCD, based on the voltage supplied to LCD
power supply, then outputs the segment signal.
When the LCD is OFF VSS is output and the potential difference between the LCD electrodes becomes 0
V.
In STOP mode, supplies from the main clocks is stopped, and the LCD drive cannnot be
operated. Set “0” to the enable flag of the LCD driver circuit before entering STOP mode.
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