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参数资料
| 型号： | MPC5554MZP80 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 28/58页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 2MB FLASH 416PBGA |
| 标准包装： | 40 |
| 系列： | MPC55xx Qorivva |
| 核心处理器： | e200z6 |
| 芯体尺寸： | 32-位 |
| 速度： | 82MHz |
| 连通性： | CAN，EBI/EMI，SCI，SPI |
| 外围设备： | DMA，POR，PWM，WDT |
| 输入/输出数： | 256 |
| 程序存储器容量： | 2MB（2M x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 64K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.35 V ~ 1.65 V |
| 数据转换器： | A/D 40x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 416-BBGA |
| 包装： | 托盘 |
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MPC5554 Microcontroller Data Sheet, Rev. 4
Electrical Characteristics
Freescale Semiconductor
34
7
Input signal valid to CLKOUT
positive edge (setup time)
External bus interface
ADDR[8:31]
DATA[0:31] 7
BG 6
BR 5
BB
RD_WR
TA
TEA 8
TS
tCIS
10.0
—
7.0
—
5.0
—
ns
8
CLKOUT positive edge to input
signal invalid (hold time)
External bus interface
ADDR[8:31]
DATA[0:31] 7
BG 6
BR 5
BB
RD_WR
TA
TEA 8
TS
tCIH
1.0
—
1.0
—
1.0
—
ns
1 EBI timing specified at: V
DDE = 1.6–3.6 V (unless stated otherwise); TA = TL to TH; and CL = 30 pF with DSC = 0b10.
2 Speed is the nominal maximum frequency. Max. speed is the maximum speed allowed including frequency modulation (FM).
82 MHz parts allow for 80 MHz system clock + 2% FM; 114 MHz parts allow for 112 MHz system clock + 2% FM; and
132 MHz parts allow for 128 MHz system clock + 2% FM.
3 The external bus is limited to half the speed of the internal bus.
5 Internal arbitration.
6 External arbitration.
7 Due to pin limitations, the DATA[16:31] signals are not available on the 324 package.
8 Due to pin limitations, the TEA signal is not available on the 324 package.
9 Due to pin limitations, the WE/BE[2:3] signals are not available on the 324 package.
10 SIU_ECCR[EBTS] = 0 timings are tested and valid at V
DDE = 2.25–3.6 V only; SIU_ECCR[EBTS] = 1 timings are tested and
valid at VDDE = 1.6–3.6 V.
Table 22. Bus Operation Timing1 (continued)
Spec
Characteristic
and
Description
Symbol
External Bus Frequency 2, 3
Unit
Notes
40 MHz
56 MHz
66 MHz
Min.
Max.
Min.
Max.
Min.
Max.
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