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参数资料
| 型号： | MPC8378ECVRAJDA |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA689 |
| 封装： | 31 X 31 MM, 2.46 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-689 |
| 文件页数： | 50/125页 |
| 文件大小： | 894K |
| 代理商： | MPC8378ECVRAJDA |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页当前第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页
MPC8378E PowerQUICC II Pro Processor Hardware Specifications, Rev. 5
Freescale Semiconductor
30
This figure shows the SGMII receiver input compliance mask eye diagram.
Figure 10. SGMII Receiver Input Compliance Mask
8.3.2
AC Requirements for SGMII L1_SD_REF_CLK and L1_SD_REF_CLK
This table lists the AC timing specifications. Note that L1_SD_REF_CLK and L1_SD_REF_CLK are not intended to be used
with, and should not be clocked by, a spread spectrum clock source.
Table 30. L1_SD_REF_CLK and L1_SD_REF_CLK AC Requirements
Parameter/Condition
Symbol
Min
Typical
Max
Unit
Note
L1_SD_REF_CLK/_B reference clock cycle time
100 MHz
125 MHz
tCK_REF
—
10
8
—ns
1, 2
L1_SD_REF_CLK/_B rise/fall time (80%-20%)
tCK_RISE/tCK_FALL
——
1
ns
—
L1_SD_REF_CLK/_B duty cycle (@50% L1_nVDD)tck_dty
45%
—
55%
ps
—
L1_SD_REF_CLK/_B cycle to cycle clock jitter (period
jitter)
tCKCJ
——
100
ps
—
L1_SD_REF_CLK/_B phase jitter peak-to-peak.
Deviation in edge location with respect to mean edge
location.
tCKPJ
–50
—
50
ps
—
Notes:
1. Both options provide serial interface bit rate of 1.25 Gbps. 8 ns only applies when 125 MHz SerDes1 clock frequency is
selected during POR.
2. Tolerance of ±100 ppm.
0.275
0.4
0.6
0.725
01
VRX_DIFFp-p-max/2
VRX_DIFFp-p-min/2
0
–VRX_DIFFp-p-min/2
–VRX_DIFFp-p-max/2
Time (UI)
Re
ceiv
e
rDi
ff
e
rential
Inpu
t
V
o
ltag
e
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