参数资料
型号: MPC8560CPX667JC
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 32-BIT, 667 MHz, RISC PROCESSOR, PBGA783
封装: 29 X 29 MM, 3.75 MM HEIGHT, 1 MM PITCH, PLASTIC, FCBGA-783
文件页数: 19/104页
文件大小: 1244K
代理商: MPC8560CPX667JC
MPC8560 Integrated Processor Hardware Specifications, Rev. 5
Freescale Semiconductor
21
DDR SDRAM
Figure 5 provides the AC test load for the DDR bus.
Figure 5. DDR AC Test Load
Figure 6 shows the DDR SDRAM output timing diagram.
Figure 6. DDR SDRAM Output Timing Diagram
6.2.2.2
Load Effects on Address/Command Bus
Table 18 provides approximate delay information that can be expected for the address and command
signals of the DDR controller for various loadings. These numbers are the result of simulations for one
topology. The delay numbers will strongly depend on the topology used. These delay numbers show the
total delay for the address and command to arrive at the DRAM devices. The actual delay could be
Table 17. DDR SDRAM Measurement Conditions
Symbol
DDR
Unit
Notes
VTH
MVREF ± 0.31 V
V
1
VOUT
0.5
× GVDD
V2
Notes:
1. Data input threshold measurement point.
2. Data output measurement point.
Output
GVDD/2
RL = 50 Ω
Z0 = 50 Ω
ADDR/CMD
DLL Phase Alignment
tDDKHOV
tDDSHMH
tDDKLDS
tDDKHDS
MDQ[x]
MDQS[n]
MSYNC_IN
MSYNC_OUT
MCK[n]
tMCK
tDDSHME
tDDKLDX
tDDKHDX
tDDSHMP
D1
D0
tDDKHOX
Write A0
NOOP
tMCK
tMCKH
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