参数资料
型号: MPC8560VTAQFC
厂商: Freescale Semiconductor
文件页数: 75/108页
文件大小: 0K
描述: MPU POWERQUICC III 783FCPBGA
标准包装: 36
系列: MPC85xx
处理器类型: 32-位 MPC85xx PowerQUICC III
速度: 1.0GHz
电压: 1.3V
安装类型: 表面贴装
封装/外壳: 784-BBGA,FCBGA
供应商设备封装: 783-FCPBGA(29x29)
包装: 托盘
MPC8560 Integrated Processor Hardware Specifications, Rev. 4.2
Freescale Semiconductor
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RapidIO
Figure 48 shows the definitions of the data to clock static skew parameter tSKEW,PAIR and the data valid
window parameter DV. The data and frame bits are those that are associated with the clock. The figure
applies for all zero-crossings of the clock. All of the signals are differential signals. VD represents VOD for
the transmitter and VID for the receiver. The center of the eye is defined as the midpoint of the region in
which the magnitude of the signal voltage is greater than or equal to the minimum DV voltage.
Figure 48. Data to Clock Skew
Figure 49 shows the definition of the data to data static skew parameter tDPAIR and how the skew
parameters are applied.
Figure 49. Static Skew Diagram
VD Clock x
tSKEW,PAIR
1.0 UI Nominal
0.5 UI
0.5 DV
Eye Opening
DV
VHDmim
VD = 0 V
VD Clock x
D[0:7]/D[8:15], FRAME
CLK0 (CLK1)
1.0 UI Nominal
0.5 UI
tDPAIR
tSKEW,PAIR
Center Point for Clock
D[0:7]/D[8:15], FRAME
Center point of the
data valid window of
the latest allowed data
bit for data grouped
late with respect
to clock
Center point of the
data valid window of
the earliest allowed data
bit for data grouped
late with respect
to clock
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PDF描述
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