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参数资料
| 型号： | MPC961C |
| 厂商： | Motorola, Inc. |
| 英文描述： | LOW VOLTAGE ZERO DELAY BUFFER |
| 中文描述： | 低压零延迟缓冲器 |
| 文件页数： | 4/12页 |
| 文件大小： | 296K |
| 代理商： | MPC961C |
MPC961C
MOTOROLA
TIMING SOLUTIONS
DL207 — Rev 0
Table 6: DC CHARACTERISTICS
(VCC = 2.5V
±
5%, TA = –40
°
to 85
°
C)
Symbol
Characteristic
Min
Typ
Max
Unit
Condition
VIH
VIL
VOH
VOL
ZOUT
IIN
CIN
CPD
ICCA
ICC
VTT
a. The MPC961C is capable of driving 50
transmission lines on the incident edge. Each output drives one 50
parallel terminated
transmission line to a termination voltage of VTT. Alternatively, the device drives up two 50
series terminated transmission lines.
Table 7: AC CHARACTERISTICS
(VCC = 2.5V
±
5%, TA = –40
°
to 85
°
C)a
Symbol
Characteristic
Input HIGH Voltage
1.7
VCC + 0.3
0.7
V
LVCMOS
Input LOW Voltage
–0.3
V
LVCMOS
IOH = –15mAa
IOL = 15mAa
Output HIGH Voltage
1.8
V
Output LOW Voltage
0.6
V
Output Impedance
18
26
Input Current
±
120
μ
A
Input Capacitance
4.0
pF
Power Dissipation Capacitance
8.0
10
pF
Per Output
Maximum PLL Supply Current
2.0
5.0
mA
VCCA Pin
All VCC Pins
Maximum Quiescent Supply Current
mA
Output Termination Voltage
VCC
2
V
Min
Typ
Max
Unit
Condition
fref
Input Frequency
F_RANGE = 0
F_RANGE = 1
100
50
200
100
MHz
fmax
Maximum Output Frequency
F_RANGE = 0
F_RANGE = 1
100
50
200
100
MHz
frefDC
tr, tf
t(
)
Reference Input Duty Cycle
25
75
%
TCLK Input Rise/Fall Time
3.0
ns
0.7 to 1.7V
Propagation Delay
(static phase offset)
Output–to–Output Skewb
CCLK to FB_IN
–80
120
ps
PLL locked
tsk(O)
DCO
90
150
ps
Output Duty Cycle
F_RANGE = 0
F_RANGE = 1
40
45
50
50
60
55
%
tr, tf
tPLZ,HZ
tPZL,LZ
tJIT(CC)
tJIT(PER)
tJIT(
)
tlock
a. AC characteristics apply for parallel output termination of 50 to VTT
b. See applications section for part–to–part skew calculation
c. See applications section for calculation for other confidence factors than 1
Output Rise/Fall Time
0.1
1.0
ns
0.6 to 1.8V
Output Disable Time
10
ns
Output Enable Time
10
ns
Cycle–to–Cycle Jitter
RMS (1 )c
15
ps
Period Jitter
RMS (1 )
7.0
10
ps
I/O Phase Jitter
RMS (1 )
15
ns
Maximum PLL Lock Time
10
ms
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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