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参数资料
| 型号： | OR3L165B8PS432-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1024 CLBS, 120000 GATES, 333 MHz, PBGA432 |
| 封装： | EBGA-432 |
| 文件页数： | 6/77页 |
| 文件大小： | 873K |
| 代理商： | OR3L165B8PS432-DB |
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14
PD78052, 78053, 78054, 78055, 78056, 78058
Data Sheet U12327EJ5V0DS00
3.3
Pin I/O Circuits and Recommended Connection of Unused Pins
The input/output circuit type of each pin and recommended connection of unused pins are shown in Table 3-1.
For the input/output circuit configuration of each type, refer to Figure 3-1.
Table 3-1. Types of Pin Input/Output Circuits (1/2)
Pin Name
Input/Output
I/O
Recommended Connection of Unused Pins
Circuit Type
P00/INTP0/TI00
2
Input
Connect to VSS .
P01/INTP1/TI01
8-A
I/O
Input:
Independently connect to VSS via a resistor.
P02/INTP2
Output: Leave open.
P03/INTP3
P04/INTP4
P05/INTP5
P06/INTP6
P07/XT1
16
Input
Connect to VDD.
P10/ANI0 to P17/ANI7
11
I/O
Input:
Independently connect to VDD or VSS via a resistor.
P20/SI1
8-A
Output: Leave open.
P21/SO1
5-A
P22/SCK1
8-A
P23/STB
5-A
P24/BUSY
8-A
P25/SI0/SB0
10-A
P26/SO0/SB1
P27/SCK0
P30/TO0
5-A
P31/TO1
P32/TO2
P33/TI1
8-A
P34/TI2
P35/PCL
5-A
P36/BUZ
P37
P40/AD0 to P47/AD7
5-E
Input:
Independently connect to VDD via a resistor.
Output: Leave open.
P50/A8 to P57/A15
5-A
Input:
Independently connect to VDD or VSS via a resistor.
Output: Leave open.
P60 to P63
13-B
Input:
Independently connect to VDD via a resistor.
Output: Leave open.
P64/RD
5-A
Input:
Independently connect to VDD or VSS via a resistor.
P65/WR
Output: Leave open.
P66/WAIT
P67/ASTB
相关PDF资料 |
PDF描述 |
|---|---|
| OR3L165B8PS680-DB | FPGA, 1024 CLBS, 120000 GATES, 333 MHz, PBGA680 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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