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参数资料
| 型号： | ORSO42G5-3BM484C |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 130/153页 |
| 文件大小： | 0K |
| 描述： | IC FPSC TRANSCEIVER 4CH 484-BGA |
| 产品变化通告： | Product Discontinuation 01/Aug/2011 |
| 标准包装： | 60 |
| 系列： | * |
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Lattice Semiconductor
ORCA ORSO42G5 and ORSO82G5 Data Sheet
78
Register Reset Conditions
The reset conditions for the registers vary depending on register type. See the tables and the accompanying text
for a description of the reset conditions.
Table 21. SERDES Alarm and Alarm Mask Register Descriptions – ORSO42G5
(0x)
Absolute
Address
Bit
Name
Reset
Value
(0x)
Description
Mode
SERDES Alarm Registers (Read Only) xx = [AC, AD, BC, BD]
30020 - AC
30030 - AD
30120 - BC
30130 - BD
[0]
RSVD
00
Reserved - May be non-zero
—
[1]
LKI_xx
Receive PLL Lock Indication, Channel xx.
LKI_xx = 1 indicates the receive PLL is locked.
Note that the PLL can either lock to the incom-
ing data or to RECLK_[A:B]. If the PLL is locked
to data and the data stream is terminated,
LKI_xx will go low until the PLL locks to
REFCLK_[A:B].
Both
[2:7]
RSVD
Reserved - May be non-zero
—
SERDES Alarm Mask Registers (Read/Write) xx = [AC, AD, BC, BD]
30021 - AC
30031 - AD
30121 - BC
30131 - BD
[0]
RSVD
FF
Reserved
—
[1]
MLKI_xx
Mask Receive PLL Lock Indication, Channel
MLKI_xx = 1 indicates LKI_xx is enabled
Both
[2:7]
RSVD
Reserved
—
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| ORSO82G5-1BM680I | 功能描述:FPGA - 现场可编程门阵列 10368 LUT 372 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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