参数资料
型号: PC100-323-620
厂商: SIEMENS AG
英文描述: 3.3V 2M x 64/72-Bit 1 BANK SDRAM Module 3.3V 4M x 64/72-Bit 2 BANK SDRAM Module
中文描述: 3.3 2米x 64/72-Bit一银行内存模块3.3 4米× 64/72-Bit 2银行内存模块
文件页数: 9/17页
文件大小: 104K
代理商: PC100-323-620
HYS64(72)V2200/4220GU-8/-10
SDRAM-Modules
Semiconductor Group
9
Refresh Cycle
Self Refresh Exit Time
t
SREX
t
REF
10
10
10
ns
9)
Refresh Period (4096 cycles)
64
64
64
ms
8)
Read Cycle
Data Out Hold Time
t
OH
t
LZ
3
3
3
ns
4)
Data Out to Low Impedance
Time
0
0
0
ns
Data Out to High Impedance
Time
t
HZ
3
9
3
9
3
9
ns
10)
DQM Data Out Disable
Latency
t
DQZ
2
2
2
CLK
Write Cycle
Data input to Precharge (write
recovery)
t
DPL
2
2
2
CLK
Data In to Active/refresh
t
DAL
t
DQW
5
5
5
CLK
11)
DQM Write Mask Latency
0
0
0
CLK
Parameter
Symbol
Limit Values
Unit
Note
-8
PC100
2-2-2
-8-3
PC100
3-2-3
-10
PC66
2-2-2
min.
max.
min.
max.
min.
max.
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