PC9RS08KA2PAE (Freescale) PDF资料下载 Datasheet(54/136 页)

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参数资料

型号：	PC9RS08KA2PAE
厂商：	Freescale Semiconductor
文件页数：	54/136页
文件大小：	0K
描述：	MCU 8BIT 2KB FLASH RS08 8-DIP
标准包装：	50
系列：	RS08
核心处理器：	RS08
芯体尺寸：	8-位
速度：	10MHz
外围设备：	LVD，POR，WDT
输入/输出数：	4
程序存储器容量：	2KB（2K x 8）
程序存储器类型：	闪存
RAM 容量：	63 x 8
电压 - 电源 (Vcc/Vdd)：	1.8 V ~ 5.5 V
振荡器型：	内部
工作温度：	0°C ~ 70°C
封装/外壳：	8-DIP（0.300"，7.62mm）
包装：	管件
配用：	DEMO9RS08KA2-ND - DEMO BOARD FOR 9RS08KA2

第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页当前第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页

Chapter 3 Modes of Operation

MC9RS08KA2 Series Data Sheet, Rev. 4

Freescale Semiconductor

the IREFSTEN bit. For the ICS to run in stop, the LVDE and LVDSE bits in the SPMSC1 must both be

set before entering stop.

3.6.1

Active BDM Enabled in Stop Mode

Entry into active background mode from run mode is enabled if the ENBDM bit in BDCSCR is set. This

executes a STOP instruction, the system clocks to the background debug logic remain active when the

MCU enters stop mode so background debug communication is still possible. In addition, the voltage

regulator does not enter its low-power standby state; it maintains full internal regulation.

Most background commands are not available in stop mode. The memory-access-with-status commands

do not allow memory access, but they report an error indicating that the MCU is in either stop or wait

mode. The BACKGROUND command can be used to wake the MCU from stop and enter active

background mode if the ENBDM bit is set. After active background mode is entered, all background

commands are available.

Table 3-3 summarizes the behavior of the MCU in stop when entry into the active background mode is

enabled.

3.6.2

LVD Enabled in Stop Mode

The LVD system is capable of generating either an interrupt or a reset when the supply voltage drops below

the LVD voltage. If the LVD is enabled in stop (LVDE and LVDSE bits in SPMSC1 both set) at the time

the CPU executes a STOP instruction, the voltage regulator remains active.

Table 3-4 summarizes the behavior of the MCU in stop when LVD reset is enabled.

Table 3-3. BDM Enabled Stop Mode Behavior

Mode

CPU

Digital

Peripherals

ICS

ACMP

Regulator

I/O Pins

RTI

Stop

Standby

Optionally

States held

Optionally on

Table 3-4. LVD Enabled Stop Mode Behavior