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参数资料
| 型号： | PEF2256 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 通信及网络 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件页数： | 7/518页 |
| 文件大小： | 6420K |
| 代理商： | PEF2256 |
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FALC
56
PEF 2256 H/E
Table of Contents
Page
User’s Manual
Hardware Description
7
DS1.1, 2003-10-23
5.5.2
5.5.2.1
5.5.3
5.6
5.6.1
5.6.2
5.6.3
5.6.4
5.6.5
5.6.6
5.6.7
5.7
Transmit System Interface (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . 179
Transmit Offset Programming . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 185
Time Slot Assigner (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 187
Test Functions (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 188
Pseudo-Random Binary Sequence Generation and Monitor . . . . . . . . 188
Remote Loop . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 188
Payload Loop-Back . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190
Local Loop . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191
Single Channel Loop-Back (loop-back of time slots) . . . . . . . . . . . . . . 192
Alarm Simulation (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193
Single Bit Defect Insertion . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193
J1-Feature Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193
6
6.1
6.2
6.3
6.4
6.5
Operational Description E1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
Operational Overview E1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
Device Reset E1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
Device Initialization in E1 Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
Digital Clock Interface Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201
Output Signal Tristate Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202
7
7.1
7.2
7.3
7.4
7.5
Operational Description T1/J1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
Operational Overview T1/J1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
Device Reset T1/J1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
Device Initialization in T1/J1 Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203
Digital Clock Interface Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210
Output Signal Tristate Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210
8
8.1
8.1.1
8.1.2
8.1.3
8.1.4
8.1.5
8.1.6
8.2
8.3
8.3.1
8.3.2
8.3.3
8.3.4
8.3.5
8.3.6
8.3.7
Signaling Controller Operating Modes
. . . . . . . . . . . . . . . . . . . . . . . . 211
HDLC Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
Non-Auto Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211
Transparent Mode 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212
Transparent Mode 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212
SS7 Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212
Receive Data Flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212
Transmit Data Flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214
Extended Transparent Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214
Signaling Controller Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 215
Transparent Transmission and Reception . . . . . . . . . . . . . . . . . . . . . . 215
CRC on/off Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 215
Receive Address Pushed to RFIFO . . . . . . . . . . . . . . . . . . . . . . . . . . . 216
HDLC Data Transmission . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 216
HDLC Data Reception . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218
Sa-bit Access (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 218
Bit Oriented Message Mode (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . 219
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| PEF2256EV2.2PB | 制造商:Infineon Technologies AG 功能描述:SP000057018_FRAMED/LINE INTERF_TRAY_PB |
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