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参数资料
| 型号： | PIC17C42AT-25I/L |
| 厂商： | Microchip Technology |
| 文件页数： | 212/241页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 2KX16 PWM 44PLCC |
| 标准包装： | 500 |
| 系列： | PIC® 17C |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 25MHz |
| 连通性： | UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 33 |
| 程序存储器容量： | 4KB（2K x 16） |
| 程序存储器类型： | OTP |
| RAM 容量： | 232 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 6 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-LCC（J 形引线） |
| 包装： | 带卷 (TR) |
| 配用： | AC164317-ND - MODULE SKT MPLAB PM3 44PLCC DVA17XL441-ND - DEVICE ADAPTER FOR PIC17C42A |
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PIC17C4X
DS30412C-page 72
1996 Microchip Technology Inc.
FIGURE 12-2: TCON2 REGISTER (ADDRESS: 17h, BANK 3)
R - 0
R/W - 0
CA2OVF CA1OVF PWM2ON PWM1ON CA1/PR3 TMR3ON TMR2ON TMR1ON
R = Readable bit
W = Writable bit
-n = Value at POR reset
bit7
bit0
bit 7:
CA2OVF: Capture2 Overow Status bit
This bit indicates that the capture value had not been read from the capture register pair (CA2H:CA2L)
before the next capture event occurred. The capture register retains the oldest unread capture value (last
capture before overow). Subsequent capture events will not update the capture register with the Timer3
value until the capture register has been read (both bytes).
1 = Overow occurred on Capture2 register
0 = No overow occurred on Capture2 register
bit 6:
CA1OVF: Capture1 Overow Status bit
This bit indicates that the capture value had not been read from the capture register pair
(PR3H/CA2H:PR3L/CA2L) before the next capture event occurred. The capture register retains the old-
est unread capture value (last capture before overow). Subsequent capture events will not update the
capture register with the TMR3 value until the capture register has been read (both bytes).
1 = Overow occurred on Capture1 register
0 = No overow occurred on Capture1 register
bit 5:
PWM2ON: PWM2 On bit
1 = PWM2 is enabled (The RB3/PWM2 pin ignores the state of the DDRB<3> bit)
0 = PWM2 is disabled (The RB3/PWM2 pin uses the state of the DDRB<3> bit for data direction)
bit 4:
PWM1ON: PWM1 On bit
1 = PWM1 is enabled (The RB2/PWM1 pin ignores the state of the DDRB<2> bit)
0 = PWM1 is disabled (The RB2/PWM1 pin uses the state of the DDRB<2> bit for data direction)
bit 3:
CA1/PR3: CA1/PR3 Register Mode Select bit
1 = Enables Capture1 (PR3H/CA1H:PR3L/CA1L is the Capture1 register. Timer3 runs without
a period register)
0 = Enables the Period register (PR3H/CA1H:PR3L/CA1L is the Period register for Timer3)
bit 2:
TMR3ON: Timer3 On bit
1 = Starts Timer3
0 = Stops Timer3
bit 1:
TMR2ON: Timer2 On bit
This bit controls the incrementing of the Timer2 register. When Timer2:Timer1 form the 16-bit timer (T16
is set), TMR2ON must be set. This allows the MSB of the timer to increment.
1 = Starts Timer2 (Must be enabled if the T16 bit (TCON1<3>) is set)
0 = Stops Timer2
bit 0:
TMR1ON: Timer1 On bit
When T16 is set (in 16-bit Timer Mode)
1 = Starts 16-bit Timer2:Timer1
0 = Stops 16-bit Timer2:Timer1
When T16 is clear (in 8-bit Timer Mode)
1 = Starts 8-bit Timer1
0 = Stops 8-bit Timer1
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