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参数资料
| 型号： | PIC18F66K90-E/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 57/110页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 64KB FLASH 64TQFP |
| 标准包装： | 160 |
| 系列： | PIC® XLP™ 18F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 64MHz |
| 连通性： | I²C，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，LCD，POR，PWM，WDT |
| 输入/输出数： | 53 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 数据转换器： | A/D 16x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页当前第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页
2010 Microchip Technology Inc.
Preliminary
DS39964B-page 503
PIC18F47J53 FAMILY
CALLW
Subroutine Call Using WREG
Syntax:
CALLW
Operands:
None
Operation:
(PC + 2)
TOS,
(W)
PCL,
(PCLATH)
PCH,
(PCLATU)
PCU
Status Affected:
None
Encoding:
0000
0001
0100
Description
First, the return address (PC + 2) is
pushed onto the return stack. Next, the
contents of W are written to PCL; the
existing value is discarded. Then, the
contents of PCLATH and PCLATU are
latched into PCH and PCU,
respectively. The second cycle is
executed as a NOP instruction while the
new next instruction is fetched.
Unlike CALL, there is no option to
update W, STATUS or BSR.
Words:
1
Cycles:
2
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
WREG
Push PC to
stack
No
operation
No
operation
No
operation
No
operation
No
operation
Example:
HERE
CALLW
Before Instruction
PC
=
address (HERE)
PCLATH =
10h
PCLATU =
00h
W
=
06h
After Instruction
PC
=
001006h
TOS
=
address (HERE + 2)
PCLATH =
10h
PCLATU =
00h
W
=
06h
MOVSF
Move Indexed to f
Syntax:
MOVSF [zs], fd
Operands:
0
zs 127
0
fd 4095
Operation:
((FSR2) + zs) fd
Status Affected:
None
Encoding:
1st word (source)
2nd word (destin.)
1110
1111
1011
ffff
0zzz
ffff
zzzzs
ffffd
Description:
The contents of the source register are
moved to destination register ‘fd’. The
actual address of the source register is
determined by adding the 7-bit literal
offset ‘zs’, in the first word, to the value
of FSR2. The address of the destination
register is specified by the 12-bit literal
‘fd’ in the second word. Both addresses
can be anywhere in the 4096-byte data
space (000h to FFFh).
The MOVSF instruction cannot use the
PCL, TOSU, TOSH or TOSL as the
destination register.
If the resultant source address points to
an Indirect Addressing register, the
value returned will be 00h.
Words:
2
Cycles:
2
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Determine
source addr
Determine
source addr
Read
source reg
Decode
No
operation
No dummy
read
No
operation
Write
register ‘f’
(dest)
Example:
MOVSF
[05h], REG2
Before Instruction
FSR2
=
80h
Contents
of 85h
=
33h
REG2
=
11h
After Instruction
FSR2
=
80h
Contents
of 85h
=
33h
REG2
=
33h
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