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参数资料
| 型号： | PLL2128X |
| 元件分类： | PLL合成/DDS/VCOs |
| 英文描述： | PLL FREQUENCY SYNTHESIZER, 40 MHz |
| 文件页数： | 3/13页 |
| 文件大小： | 76K |
| 代理商： | PLL2128X |
20MHZ ~ 100MHZ FSPLL
PLL2128X (PRELIMINARY)
11
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Parameter
Customer
SEC
Unit
Process
0.13um CMOS
Supply voltage (VDD)
1.5
± 0.08
V
Input frequency (FIN)
10 ~ 40
MHz
Output frequency (FOUT)
20 ~ 100
MHz
Cycle to cycle jitter (TJCC)
20M ~ 60M
TBD
psec (pk-pk)
60M ~ 100M
TBD
Period jitter (TJP)
20M ~ 60M
TBD
psec (pk-pk)
60M ~ 100M
TBD
Output duty ratio (TOD)
40 ~ 60
%
Lock up time (TLT)
TBD
usec
Dynamic current
< 3m
A
Stand by current
TBD
A
Filter capacitor
External
–
— How many PLLs are embedded in your system ?
— Do you need synchronization between input clock and output clock ?
— Do you need another spec of jitter ?
Parameter
Customer
Unit
Long-term jitter (TJLT)
psec (pk-pk)
Tracking Jitter (TJT)
psec (pk-pk)
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PDF描述 |
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