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参数资料
| 型号： | PLL2128X |
| 元件分类： | PLL合成/DDS/VCOs |
| 英文描述： | PLL FREQUENCY SYNTHESIZER, 40 MHz |
| 文件页数： | 4/13页 |
| 文件大小： | 76K |
| 代理商： | PLL2128X |
PLL2128X (PRELIMINARY)
20MHZ ~ 100MHZ FSPLL
12
JITTER DEFINITION
Period Jitter
Period jitter is the maximum deviation of output clock's transition from its ideal position.
T1
TJP
Fout
Ideal Cycle
Cycle-to-Cycle Jitter
Cycle-to-cycle jitter is the maximum deviation of output clock's transition from its corresponding position of the
previous cycle.
Ti-1
Ti
Ti+1
Fout
TJCC = max (Ti+1 - Ti)
Long-Term Jitter
Long-term jitter is the maximum deviation of output clock' transition from its ideal position, after many cycles.
The term "many" depends on the application and the frequency.
TJLP
Cycle 0
Cycle N
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