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参数资料
| 型号： | PSD511B1 |
| 英文描述： | PSD5XX/ZPSD5XX FAMILY FIELD-PROGRAMMABLE MICROCONTROLLER PERIPHERALS |
| 中文描述： | PSD5XX/ZPSD5XX家庭领域，可编程微控制器外设 |
| 文件页数： | 126/153页 |
| 文件大小： | 1036K |
| 代理商： | PSD511B1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页当前第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页
PSD5XX Famly
123
-20
-25
EPROM_CMiser
ON
Symbol
Parameter
Conditions
Min Max Min Max
Unit
t
LVLX
t
AVLX
t
LXAX
t
AVQV
t
SLQV
ALE or AS Pulse Width
30
30
0
ns
Address Setup Time
(Note 4)
12
15
0
ns
Address Hold Time
(Note 4)
12
17
0
ns
Address Valid to Data Valid
(Note 4)
200
250
Add 20
ns
CS Valid to Data Valid
200
275
Add 20
ns
RD to Data Valid 8/16-Bit Bus
(Note 1)
50
80
0
ns
RD to Data Valid 8-Bit Bus,
8031 Separate Mode
t
RLQV
(Note 2)
57
90
0
ns
RD to Data Valid from Interrupt Controller (Note 3)
50
90
0
ns
t
RHQX
t
RLRH
t
RHQZ
t
EHEL
t
THEH
t
ELTL
RD Data Hold Time
(Note 1)
0
0
0
ns
RD Pulse Width
(Note 1)
40
70
0
ns
RD to Data High-Z
(Note 1)
45
45
0
ns
E Pulse Width
40
70
0
ns
R/W Setup Time to Enable
20
22
0
ns
R/W Hold Time After Enable
0
0
0
ns
In 16-Bit Data Bus
Mode (Note 5)
t
AVPV
Address Input Valid to
Address Output Delay
40
60
0
ns
In 8-Bit Data Bus
Mode (Note 5)
50
60
0
ns
Read Timng
(3.0 V ± 10%)
Explanation of AC Symbols for Non ZPLD Timing.
Example:
t
AVLX
Time from Address Valid to ALE Invalid.
A
– Address
L
– Logic Level Low or ALE
C
– Power Down
N
– Reset
D
– Input Data
P
– Port Signal
E
– E
Q
– Output Data
H
– Logic Level High
R
– WR, UDS, LDS, DS, IORD, PSEN
I
– Interrupt
S
– Chip Select
T
– R/W
t
– Time
V
– Valid
X
– No Longer a Valid Logic Level
Z
– Float
13.11 Microcontroller Interface –AC/DC Parameters
(ZPSD5XXV Versions)
NOTES:
1. RD timing has the same timing as PSEN, DS, LDS, UDS signals (in 8031 combined mode).
2. RD and PSEN have the same timing for 8031 separate mode.
3. Read to Data Valid of the Interrupt Request Latch and Interrupt Priority Status. RD timing has the same timing as PSEN, DS, LDS,
UDS signals.
4. Any input used to select an internal ZPSD5XX function.
5. In multiplexed mode latched address generated from ADIO delay to address output on any Port.
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PDF描述 |
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参数描述 |
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| PSD511B1-12JI | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field-Programmable Peripheral |
| PSD511B1-12LI | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field-Programmable Peripheral |
| PSD511B1-12U | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Field-Programmable Peripheral |
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