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参数资料
| 型号： | PSD813FH |
| 英文描述： | Field Programmble Microcontroller Peripherals With Flash Memory(带闪存的现场可编程微控制器) |
| 中文描述： | 场可编程微控制器外围设备与快闪记忆体（带闪存的现场可编程微控制器） |
| 文件页数： | 16/83页 |
| 文件大小： | 369K |
| 代理商： | PSD813FH |
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PSD813FN/FH
Prelimnary
16
PLDs
(cont.)
(INPUTS)
(4)
(16)
(3)
(1)
A[15:0]
PGR[3:0]
CNTRL[2:0], READ/WRITE
CONTROL SIGNALS
PDN
APD OUTPUT
POLARITY
BIT
POLARITY
BIT
POLARITY
BIT
ECS0
ECS1
ECS6
Figure 5. ECSPLDLogic Array
General PLD
The General PLD (GPLD) is used to implement system logic such as MCU loadable
counters, system mailboxes or handshaking protocols. In addition, the GPLD can
implement random logic and state machine functions.
The GPLD has Output and Input Micro
Cells (see Figure 6). The Micro
Cells are
configured using the PSDsoft development system. Like the other PLDs, the GPLD has an
AND array which can generate up to 109 product terms, a maximum of nine product terms
for each of the twelve Micro
Cells.
The Input and Output Micro
Cells are connected to the PSD813FN/FH internal data bus
and can be directly accessed by the microcontroller. This enables the MCU software to load
data into the Output Micro
Cells or read data from both the Input and Output Micro
Cells
with no overhead visible to the user. This feature allows efficient implementation of system
logic and eliminates the need to connect the data bus to the AND logic array as required in
most standard PLD macrocell architectures.
Pins may also be driven as outputs by the MCU directly using MCU I/O Mode (see page
32). If the user drives pins with MCU I/O Mode, the underlying output Micro
Cell may be
used for embedded nodes.
相关PDF资料 |
PDF描述 |
|---|---|
| PSD82 | Three Phase Rectifier Bridges |
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相关代理商/技术参数 |
参数描述 |
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