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参数资料
| 型号： | PSD913F1V-12J |
| 厂商： | 意法半导体 |
| 英文描述： | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| 中文描述： | Flash在系统可编程ISP的外设的8位微控制器 |
| 文件页数： | 30/94页 |
| 文件大小： | 476K |
| 代理商： | PSD913F1V-12J |
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PLD
INPUT
BUS
8
CSIOP SELECT
SRAM SELECT
PLD OUT
8
PORT A PLD INPUT
8
PORT C PLD INPUT
8
PORT B PLD INPUT
8
PORT D PLD INPUT
3
SECONDARY FLASH MEMORY SELECTS
DECODE PLD
GENERAL
PURPOSE PLD
PAGE
REGISTER
GPLD
PORT A
PORT B
PORT D
PORT C
FLASH MEMORY SELECTS
DATA
BUS
8
4
1
57
PLD OUT
8
PLD OUT
3
Figure 9. PLD Block Diagrams
PSD9XX Family
Preliminary Information
32
(INPUTS)
(24)
(16)
(1)
PDN (APD OUTPUT)
I /O PORTS (PORT A,B,C)
(8)
PGR0 - PGR7
A[15:0]
*
(3)
PD[2:0] (ALE,CLKIN,CSI)
CNTRL[2:0] (READ/WRITE CONTROL SIGNALS)
(1)
RESET
RD_BSY
RS0
CSIOP
8 FLASH MEMORY
SECTOR SELECTS
4 SECONDARY
FLASH MEMORY
SECTOR SELECTS
SRAM SELECT
I/O DECODER
SELECT
CSBOOT 0
CSBOOT 1
CSBOOT 2
CSBOOT 3
FS0
FS7
3
2
Figure 10. DPLD Logic Array
*NOTE: The address inputs are A[19:4] in 80C51XA mode.
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PDF描述 |
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参数描述 |
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