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参数资料
| 型号： | S1R72V18B10 |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA121 |
| 封装： | PLASTIC, FBGA-121 |
| 文件页数： | 13/37页 |
| 文件大小： | 365K |
| 代理商： | S1R72V18B10 |
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6. Terminal Functions
S1R72V18 Data Sheet (Rev. 1.00)
EPSON
15
CPU I/F
Pin
Ball
Name
I/O
RESET
Terminal
type
Terminal description
Bus Mode
16bit Strobe mode
16bit BE mode
17
J2
XRESET
IN
-
Reset signal
33
L7
XRD
IN
-
Read/strobe
35
J7
XWRL (XWR)
IN
-
Write/strobe (lower)
Write/strobe
34
K7
XWRH
(XBEH)
IN
-
Write/strobe (upper)
High-byte enable
32
J6
XCS
IN
-
Chip select signal
31
K6
XINT
OUT
High
2mA
(Tri-state)
Interrupt output signal
37
K8
XDREQ0
OUT
High
2mA
Port 0 DMA request
38
L9
XDACK0
IN
-
Port 0 DMA acknowledge
39
K9
XDREQ1
OUT
High
2mA
Port 1 DMA request
40
L10
XDACK1
IN
-
Port 1 DMA acknowledge
18
K1
XBEL
IN
-
Set to High or Low
Low-byte enable
20
K2
CA1
IN
-
21
L2
CA2
IN
-
22
K3
CA3
IN
-
23
L3
CA4
IN
-
24
J4
CA5
IN
-
26
K4
CA6
IN
-
27
K5
CA7
IN
-
28
L5
CA8
IN
-
29
J5
CA9
IN
-
CPU bus address
42
J11
CD0
BI
Hi-Z
2mA
43
J10
CD1
BI
Hi-Z
2mA
44
H10
CD2
BI
Hi-Z
2mA
45
H11
CD3
BI
Hi-Z
2mA
46
G9
CD4
BI
Hi-Z
2mA
47
G10
CD5
BI
Hi-Z
2mA
49
F9
CD6
BI
Hi-Z
2mA
50
F10
CD7
BI
Hi-Z
2mA
51
F11
CD8
BI
Hi-Z
2mA
52
E9
CD9
BI
Hi-Z
2mA
53
E10
CD10
BI
Hi-Z
2mA
55
D11
CD11
BI
Hi-Z
2mA
56
D10
CD12
BI
Hi-Z
2mA
57
C11
CD13
BI
Hi-Z
2mA
58
C10
CD14
BI
Hi-Z
2mA
59
B10
CD15
BI
Hi-Z
2mA
CPU data bus
The XINT terminal can be set to 1/0 or Hi-Z/0 mode, depending on register settings.
PD: Pull Down
PU: Pull Up
相关PDF资料 |
PDF描述 |
|---|---|
| S1R72V27B05 | UNIVERSAL SERIAL BUS CONTROLLER, PBGA60 |
| S2024B-8 | 32-BIT, DSP-CROSSBAR SWITCH, PQFP196 |
| S2025A | 32-BIT, DSP-CROSSBAR SWITCH, PQFP196 |
| S2025C-15 | 32-BIT, DSP-CROSSBAR SWITCH, PQFP196 |
| S2028A | 32-BIT, DSP-CROSSBAR SWITCH, PQFP224 |
相关代理商/技术参数 |
参数描述 |
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