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参数资料
| 型号： | S80960SB-10 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 10 MHz, RISC PROCESSOR, PQFP80 |
| 封装： | EIAJ, QFP-80 |
| 文件页数： | 14/38页 |
| 文件大小： | 1870K |
| 代理商： | S80960SB-10 |
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17
80960SB
Table 8. 80960SB AC Characteristics (16 MHz)
Symbol
Parameter
Min
Max
Units
Notes
Input Clock
T1
Processor Clock Period (CLK2)
31.25
125
ns
VIN = 1.5V
T2
Processor Clock Low Time (CLK2)
8
ns
VT = 10% Point
=
VCL + (VCH – VCL) x 0.1
T3
Processor Clock High Time
(CLK2)
8
ns
VT = 90% Point
=
VCL + (VCH – VCL) x 0.9
T4
Processor Clock Fall Time (CLK2)
10
ns
VT = 90% to 10% Point (1)
T5
Processor Clock Rise Time (CLK2)
10
ns
VT = 10% to 90% Point (1)
Synchronous Outputs
T6
Output Valid Delay
2
25
ns
T6AS
AS Output Valid Delay
2
21
ns
T7
ALE Width
T1 - 11
ns
T8
ALE Output Valid Delay
2
22
ns
T9
Output Float Delay
2
20
ns
(2)
Synchronous Inputs
T10
Input Setup 1
10
ns
T11
Input Hold
2
ns
T12
Input Setup 2
13
ns
T13
Setup to ALE Inactive
10
ns
T14
Hold after ALE Inactive
8
ns
T15
RESET Hold
3
ns
(3)
T16
RESET Setup
5
ns
(3)
T17
RESET Width
1281
ns
41 CLK2 Periods Minimum
NOTES:
1. Processor clock (CLK2) rise time and fall time are not tested.
2. A float condition occurs when the maximum output current becomes less than ILO. Float delay is not tested, but should be
no longer than the valid delay.
3. Meeting RESET setup and hold times is an optional method of synchronizing your clocks. If you decide to use an asyn-
chronous reset, synchronizing the clock can be accomplished by using AS.
相关PDF资料 |
PDF描述 |
|---|---|
| S80C186XL12 | 16-BIT, 12 MHz, MICROPROCESSOR, PQFP80 |
| S80C186XL25 | 16-BIT, 25 MHz, MICROPROCESSOR, PQFP80 |
| S80C186XL20 | 16-BIT, 20 MHz, MICROPROCESSOR, PQFP80 |
| S80C188XL20 | 16-BIT, 20 MHz, MICROPROCESSOR, PQFP80 |
| S80C188XL12 | 16-BIT, 12 MHz, MICROPROCESSOR, PQFP80 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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