参数资料
型号: SCD243110QCD
厂商: INTEL CORP
元件分类: 微控制器/微处理器
英文描述: 4 CHANNEL(S), 134.4K bps, SERIAL COMM CONTROLLER, PQFP100
封装: METRIC, QFP-100
文件页数: 43/186页
文件大小: 2204K
代理商: SCD243110QCD
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Advanced Multi-Protocol Communications Controller — CD2431
Datasheet
137
Bits 4:0
Receive Data Count [4:0]
If the receive channel is interrupt driven, a non-zero value in this bit field is the num-
ber of data characters available for transfer within the current receive interrupt.
8.5.2.6
Receive Data Register (RDR)
This Virtual register accesses the receive data FIFO of a channel interrupting for receive data
transfer. This register address is used for all channels to transfer receive FIFO data to the host (if
programmed in Interrupt Transfer mode). Data must be read as bytes, and follows the rules listed in
Section 8.3 for the positioning of valid data on the bus. If the BYTESWAP pin is high, data is valid
on A/D[7:0], if BYTESWAP is low, data is valid on A/D[15:8]. This is true because the RDR is on
an even address.
8.5.2.7
Receive End of Interrupt Register (REOIR)
Asynchronous and HDLC Modes
The CD2431 interprets values written to this register at the completion of all receive interrupts.
Bit 7
Terminate Current DMA Buffer
If this bit is set, the current receive buffer is terminated and data transfer is switched
to the other buffer. This bit should only be set in response to an Async Exception
interrupt. If the buffer is terminated in response to an exception character (that is,
parity error) interrupt and the discard exception character bit is not set, the exception
character is written at the start of the next buffer.
Before writing the terminate buffer command to REOIR, a new buffer descriptor can
be written to the current buffer.
Bit 6
Discard Exception Character (DMA mode only)
When this bit is set in response to an async exception interrupt, the exception char-
acter is not transferred to memory.
Register Name: RDR
Register Description: Receive Data
Default Value: x’00
Access: Byte Read only
Intel Hex Address: x’F8
Motorola Hex Address: x’F8
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
D7
D6
D5
D4
D3
D2
D1
D0
Register Name: REOIR
Register Description: Receive End of Interrupt
Default Value: x’00
Access: Byte Write only
Intel Hex Address: x’87
Motorola Hex Address: x’84
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
TermBuff
DiscExc
SetTm2
SetTm1
NoTrans
Gap2
Gap1
Gap0
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PDF描述
SCG2500AI-019.44M 51.84 MHz, OTHER CLOCK GENERATOR, DSO14
SCG4525 4000/14000/40000 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), DSO18
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SCN2681TC1A44A 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC44
SCN68562C2N48 2 CHANNEL(S), 4M bps, MULTI PROTOCOL CONTROLLER, PDIP48
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参数描述
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