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参数资料
| 型号： | SI5317B-C-GMR |
| 厂商： | SILICON LABORATORIES |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 350 MHz, OTHER CLOCK GENERATOR, QCC36 |
| 封装： | 6 X 6 MM, ROHS COMPLIANT, MO-220VJJD, QFN-36 |
| 文件页数： | 30/46页 |
| 文件大小： | 407K |
| 代理商： | SI5317B-C-GMR |
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Si5317
36
Rev. 1.1
9. Pin Descriptions: Si5317
Note:
Pin assignments are preliminary and subject to change.
Table 14. Si5317 Pin Descriptions
Pin #
Pin Name
I/O
Signal Level
Description
1RST
ILVCMOS
External Reset.
Active low input that performs external hardware reset of
device. Resets all internal logic to a known state. Clock out-
puts are tristated during reset. After rising edge of RST sig-
nal, the Si5317 will perform an internal self-calibration when
a valid input signal is present.
This pin has a weak pull-up.
2
FRQTBL
I
3-level
Frequency Table.
Selects frequency table.
This pin has a weak pull-up and weak pull-down and defaults
to M. Some designs may require an external resistor voltage
divider when driven by an active device that will tri-state.
3LOS
O
LVCMOS
CKIN Loss of Signal.
Active high loss-of-signal indicator for CKIN. Once triggered,
the alarm will remain active until CKIN is validated.
0 = CKIN present
1 = LOS on CKIN
5, 10, 32
VDD
Supply
Supply.
The device operates from a 1.8, 2.5, or 3.3 V supply. Bypass
capacitors should be associated with the following VDD pins:
5
0.1 F
10
0.1 F
32
0.1 F
A 1.0 F should also be placed as close to device as is
practical.
1
2
3
29
30
31
32
33
34
35
36
20
21
22
23
24
25
26
27
10 11 12 13 14 15 16 17
4
5
6
7
8
FRQTBL
NC
RST
NC
LOS
GND
VDD
XA
VDD
RATE
0
NC
DB
L2_B
Y
RA
TE1
CK
IN
+
CK
IN
–
NC
BWSEL0
BWSEL1
FRQSEL1
FRQSEL2
FRQSEL3
CKOUT1–
SFO
U
T
1
GND
VD
D
SF
OU
T0
CK
O
U
T
2
-
CK
O
U
T
2
+
NC
GND
Pad
FRQSEL0
INC
9
18
19
28
XB
LO
L
DEC
CKOUT1+
相关PDF资料 |
PDF描述 |
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| SI5351A-AGM | 160 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC20 |
相关代理商/技术参数 |
参数描述 |
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