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参数资料
| 型号： | SPAKXC16Z1MFV20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, SMT-144 |
| 文件页数： | 10/200页 |
| 文件大小： | 1383K |
| 代理商： | SPAKXC16Z1MFV20 |
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MC68HC16Z1
MOTOROLA
MC68HC16Z1TS/D
107
STOP — Stop Clocks
0 = Internal clocks not shut down
1 = Internal clocks shut down
FRZ1 — Not implemented at this time
FRZ0 — FREEZE Response
0 = Ignore FREEZE
1 = FREEZE the current state of the GPT
STOPP — Stop Prescaler
0 = Normal operation
1 = Stop prescaler and pulse accumulator from incrementing. Ignore changes to input pins.
INCP — Increment Prescaler
0 = Has no meaning
1 = If STOPP is asserted, increment prescaler once and clock input synchronizers once.
SUPV — Supervisor/Unrestricted Data Space
0 = Registers with access controlled by SUPV are unrestricted (FC2 is a don't care).
1 = Registers with access controlled by SUPV are restricted when FC2 = 1.
Because the CPU16 in the MC68HC16Z1 operates in supervisor mode only (FC2 is always logic level
one), this bit has no effect.
IARB[3:0] — Interrupt Arbitration Identification
To enable interrupt arbitration, system software must set this field to a value between $F–$1; $F is the
highest priority. This field is initialized to $0 during reset. If the CPU recognizes a GPT interrupt request
while IARB = $0, a spurious interrupt exception is taken.
MTR — GPT Module Test Register (Reserved)
$YFF902
This address is currently unused and returns zeros if read. It is reserved for GPT factory test.
IPA — Interrupt Priority Adjust
Specifies which GPT interrupt source is given highest internal priority
IPL — Interrupt Priority Level
Specifies the priority level of interrupts generated by the GPT.
IVBA — Interrupt Vector Base Address
Most significant nibble of interrupt vector numbers generated by the GPT.
When GPT pins are used as an 8-bit port, DDRGP determines whether pins are input or output and
PORTGP holds the 8-bit data.
DDRGP[7:0] — Port GP Data Direction Register
0 = Input only
1 = Output
When PORTGP is used for general-purpose I/O, each bit in the DDRGP determines whether the cor-
responding PORTGP bit is input or output.
ICR — GPT Interrupt Configuration Register
$YFF904
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
IPA
0
IPL
IVBA
0
RESET:
0
DDRGP/PORTGP — Port GP Data Direction Register/Port GP Data Register
$YFF906
15
8
7
0
DDRGP
PORTGP
RESET:
0
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