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参数资料
| 型号： | SPAKXC16Z1MFV20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, SMT-144 |
| 文件页数： | 158/200页 |
| 文件大小： | 1383K |
| 代理商： | SPAKXC16Z1MFV20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页当前第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
MOTOROLA
MC68HC16Z1
60
MC68HC16Z1TS/D
ADDR[15:3] — Base Address Field
This field sets the starting address of a particular address space. The address compare logic uses only
the most significant bits to match an address within a block. The value of the base address must be a
multiple of block size. Base address register diagrams show how base register bits correspond to ad-
dress lines.
Because ADDR20 = ADDR19 in the CPU16, maximum block size is 512 Kbytes. Because ADDR[23:20]
follow the logic state of ADDR19, addresses from $080000 to $F7FFFF are inaccessible. Blocks can
be based above this dead zone, but the effect of ADDR19 must be considered.
3.5.13.4 Option Registers
The option registers contain eight fields that determine timing of and conditions for assertion of chip-
select signals and make the chip selects useful for generating peripheral control signals. All bits in the
base address register and the option register must be satisfied to assert a chip-select signal. The bits
must also be satisfied to provide DSACK or autovector support.
The option register for CSBOOT, which is CSORBT, contains special reset values that support boot-
strap operations from peripheral memory devices.
The following bit descriptions apply to both CSORBT and CSOR[10:0] option registers.
MODE — Asynchronous/Synchronous Mode
0 = Asynchronous mode selected (chip select assertion determined by internal or external bus con-
trol signals)
1 = Synchronous mode selected (chip select assertion synchronized with ECLK signal)
In asynchronous mode, the chip select is asserted synchronized with AS or DS.
BYTE — Upper/Lower Byte Option
This field is used only when the chip-select 16-bit port option is selected in the pin assignment register.
The following table lists upper/lower byte options.
If an interrupting device does not provide a vector number, an autovector acknowledge must be gener-
ated. The bus cycle is terminated by asserting AVEC. This can be done either by asserting the AVEC
pin or by generating AVEC internally, using the chip select option register.
CSORBT — Chip-Select Option Register Boot ROM
$YFFA4A
15
14
13
12
11
10
9876543210
MODE
BYTE
R/W
STRB
DSACK
SPACE
IPL
AVEC
RESET:
0
111101101110000
CSOR[10:0] — Chip-Select Option Registers
$YFFA4E–$YFFA76
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
MODE
BYTE
R/W
STRB
DSACK
SPACE
IPL
AVEC
RESET:
0
Byte
Description
00
Disable
01
Lower Byte
10
Upper Byte
11
Both Bytes
相关PDF资料 |
PDF描述 |
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