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参数资料
| 型号： | SPC5200CVR400 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 73/80页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT 400MHZ 272-PBGA |
| 标准包装： | 40 |
| 系列： | MPC52xx |
| 处理器类型： | 32-位 MPC52xx PowerPC |
| 速度： | 400MHz |
| 电压： | 1.5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
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System Design Information
MPC5200 Data Sheet, Rev. 4
Freescale Semiconductor
75
Figure 54. PORRESET vs. JTAG_TRST
5.4.1.2
Connecting JTAG_TRST
The wiring of the JTAG_TRST depends on the existence of a board-related debug interface (see Table 53
below).
Normally this interface is implemented, using a COP (common on-chip processor) connector. The COP
allows a remote computer system (typically, a PC with dedicated hardware and debugging software) to
access and control the internal operations of the MPC5200.
5.4.2
G2_LE COP/BDM Interface
There are two possibilities to connect the JTAG interface: using it with a COP connector and without a
COP connector.
5.4.2.1
Boards interfacing the JTAG port via a COP connector
The MPC5200 functional pin interface and internal logic provides access to the embedded G2_LE
processor core through the Freescale (formerly Motorola) standard COP/BDM interface. Table 53 gives
the COP/BDM interface signals. The pin order shown reflects only the COP/BDM connector order.
Table 53. COP/BDM Interface Signals
BDM
Pin #
MPC5200
I/O Pin
BDM
Connector
Internal
PullUp/Down
External
PullUp/Down
I/O1
16
—
GND
—
15
TEST_SEL_0
ckstp_out
—
I
14
—
KEY
—
13
HRESET
hreset
10k Pull-Up
O
12
—
GND
—
11
SRESET
sreset
10k Pull-Up
O
10
—
N/C
—
9
JTAG_TMS
tms
100k Pull-Up
10k Pull-Up
O
JTAG_TRST
PORRESET
required assertion of JTAG_TRST
optional assertion of JTAG_TRST
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参数描述 |
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