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参数资料
| 型号： | SSTUAF32868BHLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/22页 |
| 文件大小： | 0K |
| 描述： | IC REG BUFFER 28BIT DDR2 176BGA |
| 产品变化通告： | Product Discontinuation 09/Dec/2011 |
| 标准包装： | 1,000 |
| 逻辑类型： | 1:1、1:2 可配置寄存缓冲器 |
| 电源电压： | 1.7 V ~ 1.9 V |
| 位数： | 28 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 176-TFBGA |
| 供应商设备封装： | 176-CABGA（6x15） |
| 包装： | 带卷 (TR) |
ICSSSTUAF32868B
28-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
28-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
15
ICSSSTUAF32868B
7102/2
Register Timing
NOTES:
1.After RESET is switched from LOW to HIGH, all data and PAR_IN inputs signals must be set and held LOW for a
minimum time of tACTMAX, to avoid false error.
2.If the data is clocked in on the n clock pulse, the QERR output signal will be generated on the n+2 clock pulse, and
it will be valid on the n+3 clock pulse.
n
n +1
n+ 2
n + 3
n+ 4
tPDM, tPDMSS
CLK to Q
tSU
CLK
Dn, DODTn,
DCKEn
PARIN
QERR
Qn, QODTn,
QCKEn
tPHL
tSU
tH
tACT
tH
Data to QERR Latency
CLK to QERR
tPHL, tPLH
DCS1
DCS0
CSGEN
RESET
H, L, or X
H or L
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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