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参数资料
| 型号： | SSTUG32865ET/S |
| 厂商： | NXP SEMICONDUCTORS |
| 元件分类： | 锁存器 |
| 英文描述： | SSTU SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA160 |
| 封装： | 9 X 13 MM, 0.70 MM PITCH, LEAD FREE, PLASTIC, SOT-802-2, TFBGA-160 |
| 文件页数： | 24/28页 |
| 文件大小： | 154K |
| 代理商： | SSTUG32865ET/S |
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SSTUG32865_1
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 01 — 16 August 2007
5 of 28
NXP Semiconductors
SSTUG32865
1.8 V DDR2-1G registered buffer with parity
160-ball, 12
× 18 grid; top view.
An empty cell indicates no ball is populated at that grid point.
n.c. denotes a no-connect (ball present but not connected to the die).
MCL denotes a pin that must be connected LOW.
MCH denotes a pin that must be connected HIGH.
Fig 3.
Ball mapping
VREF
SELDR
PARIN
n.c.
QCKE1A
1
234
5
6
D1
D2
n.c.
QCKE1B
A
B
D3
D4
C
D6
D5
VDDL
GND
n.c.
D
D7
D8
VDDL
GND
VDDL
E
D11
D9
VDDL
GND
F
D18
D12
VDDL
GND
G
CSGATEEN
D15
DCS2
GND
H
CK
DCS0
GND
J
CK
DCS1
VDDL
K
D14
GND
L
D0
D10
GND
M
D17
D16
VDDL
N
D19
D21
GND
VDDL
P
D13
D20
GND
VDDL
R
DODT1
DODT0
T
002aac017
QCKE0A
Q21A
Q19A
Q18A
Q17B
Q17A
789
10
11
12
QCKE0B
Q21B
Q19B
Q18B
QODT0B
QODT0A
QODT1B
QODT1A
n.c.
GND
Q20B
Q20A
VDDR
GND
Q16B
Q16A
VDDR
Q1B
Q1A
VDDR
Q2B
Q2A
GND
Q5B
Q5A
VDDR
QCS0B
QCS0A
GND
QCS1B
QCS1A
VDDR
Q6B
Q6A
GND
Q10B
Q10A
VDDR
Q9B
Q9A
VDDR
GND
Q11B
Q11A
GND
Q15B
Q15A
Q14B
Q14A
DCKE0
DCKE1
MCL
PTYERR
MCH
Q3B
U
VREF
MCL
n.c.
MCH
Q3A
V
Q12B
Q7B
Q4B
Q13B
Q0B
Q8B
Q12A
Q7A
Q4A
Q13A
Q0A
Q8A
RESET
DCS3
相关PDF资料 |
PDF描述 |
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参数描述 |
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| SSTUG32866EC/S | 制造商:PHILIPS 制造商全称:NXP Semiconductors 功能描述:1.8 V 25-bit 1 : 1 or 14-bit 1 : 2 configurable registered buffer |
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