参数资料
型号: ST10F296TR
厂商: STMICROELECTRONICS
元件分类: 微控制器/微处理器
英文描述: 16-BIT, FLASH, 64 MHz, MICROCONTROLLER, PBGA208
封装: 23 X 23 MM, 1.96 MM HEIGHT, 1.27 MM PITCH, ROHS COMPLIANT, PLASTIC, BGA-208
文件页数: 155/346页
文件大小: 5607K
代理商: ST10F296TR
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System reset
ST10F296E
238/346
Table 133 and Figure 92 shows the start-up configurations and some system features that are selected
on reset sequences. Table 133 describes the system configurations latched onto Port 0 in the six different
reset modes. Figure 92 summarizes the state of the Port 0 bits latched in the RP0H, SYSCON, and
BUSCON0 registers.
Software reset(2)
x
0
N
Synch.
Not activated
000
10
x
0
N
Synch.
Not activated
000
10
0
1
Y
Synch.
Not activated
000
10
1
Y
Synch.
Activated by internal logic for 1024 TCL
0
1
0
Watchdog
x
0
N
Synch.
Not activated
000
11
x
0
N
Synch.
Not activated
000
11
0
1
Y
Synch.
Not activated
000
11
1
Y
Synch.
Activated by internal logic for 1024 TCL
0
1
1.
A software hardware reset can degenerate into a long hardware reset and is consequently flagged differently (see
Section 20.3 for details).
2.
When bidirectional reset is active (and RPD = 0), it can be followed by a short hardware reset and is consequently flagged
differently (see Section 20.6 for details).
Table 132.
Reset events summary
Event
RPD
EA
Bi
directio
nal
sync
hr
on
ou
s/
async
h
ro
nous
RSTIN
WDTCON flags
Min
Max
PONR
LHW
R
SHWR
SW
R
WDT
R
Table 133.
Latched configurations of Port 0 for the different reset events(1)
Sample event
Port 0
Cl
oc
k
op
tio
n
s
Segm.
ad
d
r.
li
n
e
s
Chip
selects
WR
co
nf
ig.
Bus
type
Res
e
rved
BSL
Res
e
rved
Res
e
rved
Adapt
mode
EMU
mode
P0
H.
7
P0
H.
6
P0
H.
5
P0
H.
4
P0
H.
3
P0
H.
2
P0
H.
1
P0
H.
0
P0L.7
P0L.6
P0L.5
P0L.4
P0L.3
P0L.2
P0L.1
P0L.0
Software reset
-
X
XXXX
XX
-
----
Watchdog reset
-
X
XXXX
XX
-
----
Synchronous short hardware
reset
-
X
XXXX
Synchronous long hardware
reset
XXXX
Asynchronous hardware reset
XXXX
Asynchronous power-on reset
XXXX
1.
X: Pin is sampled; -: Pin is not sampled.
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