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参数资料
| 型号： | ST72T141K2MARE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDSO34 |
| 封装： | 0.300 INCH, LEAD FREE, PLASTIC, SOP-34 |
| 文件页数： | 53/131页 |
| 文件大小： | 3096K |
| 代理商： | ST72T141K2MARE |
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ST72141K2-Auto
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POWER SAVING MODES (Cont’d)
5.2 HALT MODE
The HALT mode is the lowest power consumption
mode of the MCU. It is entered by executing the
ST7 “HALT” instruction (see Figure 20).
The MCU can exit HALT mode on reception of ei-
ther an external interrupt or a reset (see Table 2).
When exiting HALT mode by means of a RESET
or an interrupt, the oscillator is immediately turned
on and the 4096 CPU cycle delay is used to stabi-
lize the oscillator. After the start up delay, the CPU
resumes operation by servicing the interrupt or by
fetching the reset vector which woke it up (see Fig-
ure 19).
When entering HALT mode, the I bit in the CC
Register is forced to 0 to enable interrupts.
In the HALT mode the main oscillator is turned off
causing all internal processing to be stopped, in-
cluding the operation of the on-chip peripherals.
All peripherals are not clocked except the ones
which get their clock supply from another clock
generator (such as an external or auxiliary oscilla-
tor).
Figure 19. HALT Mode Timing Overview
Figure 20. HALT Mode Flowchart
HALT
RUN
4096 CPU CYCLE
DELAY
RESET
OR
INTERRUPT
HALT
INSTRUCTION
FETCH
VECTOR
HALT INSTRUCTION
Notes:
CPU
OSCILLATOR
PERIPHERALS
I BIT
OFF
0
OFF
RESET
EXTERNAL*
Y
N
Y
CPU
OSCILLATOR
PERIPHERALS
ON
OFF
INTERRUPT
HALT
FETCH RESET VECTOR
OR SERVICE INTERRUPT**
4096 clock cycles delay
CPU
OSCILLATOR
PERIPHERALS
ON
External interrupt or internal interrupts with Exit from Halt Mode capability
*
** Before servicing an interrupt, the CC register is pushed on the stack.
WATCHDOG
Y
N
ENABLE
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