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参数资料
| 型号： | ST7FLITE09Y0B3 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP16 |
| 封装： | 0.300 INCH, PLASTIC, DIP-16 |
| 文件页数： | 40/115页 |
| 文件大小： | 781K |
| 代理商： | ST7FLITE09Y0B3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页当前第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页
ST7FLITE0
30/115
SYSTEM INTEGRITY MANAGEMENT (Cont’d)
7.5.4 Register Description
SYSTEM INTEGRITY (SI) CONTROL/STATUS REGISTER (SICSR)
Read/Write
Reset Value: 0000 0x00 (0xh)
Bit 7:4 = Reserved, must be kept cleared.
Bit 3 = LOCKED
PLL Locked Flag
This bit is set and cleared by hardware. It is set au-
tomatically when the PLL reaches its operating fre-
quency.
0: PLL not locked
1: PLL locked
Bit 2 = LVDRF
LVD reset flag
This bit indicates that the last Reset was generat-
ed by the LVD block. It is set by hardware (LVD re-
set) and cleared by software (writing zero). See
WDGRF flag description in Section 11.1 for more
details. When the LVD is disabled by OPTION
BYTE, the LVDRF bit value is undefined.
Bit 1 = AVDF
Voltage Detector flag
This read-only bit is set and cleared by hardware.
If the AVDIE bit is set, an interrupt request is gen-
erated when the AVDF bit changes value. Refer to
Figure 18 for additional details
0: VDD over AVD threshold
1: VDD under AVD threshold
Bit 0 = AVDIE
Voltage Detector interrupt enable
This bit is set and cleared by software. It enables
an interrupt to be generated when the AVDF flag
changes (toggles). The pending interrupt informa-
tion is automatically cleared when software enters
the AVD interrupt routine.
0: AVD interrupt disabled
1: AVD interrupt enabled
Application notes
The LVDRF flag is not cleared when another RE-
SET type occurs (external or watchdog), the
LVDRF flag remains set to keep trace of the origi-
nal failure.
In this case, a watchdog reset can be detected by
software while an external reset can not.
Table 6. System Integrity Register Map and Reset Values
70
00
LOCK
ED
LVDRF AVDF AVDIE
Address
(Hex.)
Register
Label
765
4
321
0
003Ah
SICSR
Reset Value
000
0
LOCKED
0
LVDRF
x
AVDF
0
AVDIE
0
1
相关PDF资料 |
PDF描述 |
|---|---|
| ST7PLU09MCTRE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO8 |
| ST7PLU05MAE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO8 |
| ST7PLU09MAE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO8 |
| ST90135M5T6 | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP80 |
| ST90T158M9Q6 | 16-BIT, OTPROM, 24 MHz, MICROCONTROLLER, PQFP80 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| ST7FLITE09Y0M6 | 功能描述:8位微控制器 -MCU Flash 1.5K SPI Intrf RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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