参数资料
型号: STP1081ABGA-150
元件分类: 微控制器/微处理器
英文描述: SPECIALTY MICROPROCESSOR CIRCUIT, PBGA256
封装: PLASTIC, BGA-256
文件页数: 10/32页
文件大小: 478K
代理商: STP1081ABGA-150
18
STP1081
Preliminary
Companion Device for 250/300 MHz UltraSPARC-II Systems
UltraSPARC
-II Data Buffer (UDB-II)
July 1997
One-to-One Clock Ratio for Data Transfer, Case 1
When S_REPLY is asserted, data will transfer from UPA to UDB-II for up to four cycles, as specied in the
S_REPLY coding.
Once the UPA data is latched into UDB-II, the UltraSPARC-II asserts CNTL and two cycles later, data appears
at the output of UDB-II.
In cases of data stall, the system receives S_REPLY but SC_DATA_STALL is held high until data is complete.
Then, SC_DATA_STALL goes low and one cycle later, data from the UPA bus is transferred as described
above.
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