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参数资料
| 型号： | TC86R4600 |
| 厂商： | Toshiba Corporation |
| 英文描述： | 64 Bit RISC Microprocessor(64位精简指令集微处理器) |
| 中文描述： | 64位RISC微处理器（64位精简指令集微处理器） |
| 文件页数： | 13/30页 |
| 文件大小： | 267K |
| 代理商： | TC86R4600 |
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TC86R4600 64-bit RISC Microprocessor
T O S H IB A A M E R IC A E L E C T R O N IC C O M P O N E N T S , IN C
.
11
An address/data pair every four system cycles is not sufT-
cently high performance for all applications. For this reason,
R4600 provides two new protocol options that modify the R4000
interface protocol to allow an address/data pair every two system
cycles. The Trst protocol allows
WrRdyB
to be deasserted during
the address cycle and forces a write to be reissued. The second
leaves the sample point of
WrRdyB
unchanged and requires
that the external agent accept one more write than the R4000
protocol.
The Trst new protocol, write reissue, is illustrated in the
Tgure below. Writes issue when
WrRdyB
is asserted both two
cycles prior to the address cycle and during the address cycle.
The second new protocol, pipelined writes, maintains the
R4000 write issue rule (issue if
WrRdyB
asserted two cycles
prior to the address cycle), but simply eliminates the two null
cycles between writes. The external agent is then required to
accept one more write after it deasserts
WrRdyB
:
Figure 11. First New Protocol Write Re-issue
SysClk
SysAD
Adr0
Data0
Adr1
Data1
SysCmd
WrRdyB
Issue
NoIss
NoIss
NoIss
Issue
Data1
Adr1
Write
NEOD
Write
NEOD
NEOD
Write
Figure 12. The Second New Protocol Pipelined Writes
SysClk
SysAD
Adr0
Data0
Adr1
Data2
SysCmd
WrRdyB
Issue
NoIss
NoIss
NoIss
Issue
Data1
Adr2
Write
NEOD
Write
NEOD
NEOD
Write
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