参数资料
| 型号： | TMX320DM365BZCE |
| 厂商： | Texas Instruments |
| 文件页数： | 204/210页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL MEDIA SOC 338NFBGA |
| 标准包装： | 160 |
| 系列： | TMS320DM3x, DaVinci™ |
| 类型： | 数字媒体片内系统（DMSoC） |
| 接口： | HPI，I²C，McBSP，MMC，SD，SPI，UART，USB |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（16 kB） |
| 芯片上RAM： | 32kB |
| 电压 - 输入/输出： | 1.8V，3.3V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-LFBGA |
| 供应商设备封装： | 338-NFBGA（13x13） |
| 包装： | 托盘 |
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SPRS457E
– MARCH 2009 – REVISED JUNE 2011
Table 6-16. EDMA Channel Synchronization Events(1) (2) (continued)
EDMA
EVENT NAME
EVENT DESCRIPTION
CHANNEL
50
TIMER1: TEVT2
Timer 2(TEVT2) Event
51
TIMER1: TEVT3
Timer 3(TEVT3) Event
52
PWM0
PWM 0 Event
53
PWM1 or MJCP : IMX1INT
PWM 1 Event or MJCP IMX1INT interrupt
54
PWM2 or MJCP : NSFINT
PWM 2 Event or MJCP NSFINT interrupt
PWM3 or HDVICP(6) :
MPEG/JPEG Coprocessor PWM 3 Event or High Definition Video Image Coprocessor
55
CP_UNDEF
CP_UNDEF Event
MJCP : VLCDINT or
MPEG/JPEG Coprocessor VLCDINT Event or High Definition Video Image Coprocessor
56
HDVICP(5) : CP_ECDCMP
CP_ECDCMP Event
MJCP : BIMINT or
MPEG/JPEG Coprocessor BIMINT Event or High Definition Video Image Coprocessor
57
HDVICP(8) : CP_ME
CP_ME Event
MJCP : DCTINT or
MPEG/JPEG Coprocessor DCTINT Event or High Definition Video Image Coprocessor
58
HDVICP(1) : CP_CALC
CP_CALC Event
MJCP : QIQINT or
MPEG/JPEG Coprocessor QIQINT Event or High Definition Video Image Coprocessor
59
HDVICP(7) : CP_IPE
CP_IPE Event
MJCP : BPSINT or
MPEG/JPEG Coprocessor BPSINT Event or High Definition Video Image Coprocessor
60
HDVICP(2) : CP_BS
CP_BS Event
MJCP : VLCDERRINT or
MPEG/JPEG Coprocessor VLCDERRINT Event or High Definition Video Image Coprocessor
61
HDVICP(0) : CP_LPF
CP_LPF Event
MJCP : RCNTINT or
MPEG/JPEG Coprocessor RCNTINT Event or High Definition Video Image Coprocessor
62
HDVICP(3) : CP_MC
CP_MC Event
MJCP : COPCINT or
MPEG/JPEG Coprocessor COPCINT Event or High Definition Video Image Coprocessor
63
HDVICP(4) : CP_ECDEND
CP_ECDEND Event
6.9.2
EDMA Peripheral Register Description(s)
Table 6-17 lists the EDMA registers, their corresponding acronyms, and device memory locations
(offsets).
Table 6-17. EDMA Registers
Offset
Acronym
Register Description
00h
PID
Peripheral Identification Register
04h
CCCFG
EDMA3CC Configuration Register
Global Registers
0200h
QCHMAP0
QDMA Channel 0 Mapping Register
0204h
QCHMAP1
QDMA Channel 1 Mapping Register
0208h
QCHMAP2
QDMA Channel 2 Mapping Register
020Ch
QCHMAP3
QDMA Channel 3 Mapping Register
0210h
QCHMAP4
QDMA Channel 4 Mapping Register
0214h
QCHMAP5
QDMA Channel 5 Mapping Register
0218h
QCHMAP6
QDMA Channel 6 Mapping Register
021Ch
QCHMAP7
QDMA Channel 7 Mapping Register
0240h
DMAQNUM0
DMA Queue Number Register 0
0244h
DMAQNUM1
DMA Queue Number Register 1
0248h
DMAQNUM2
DMA Queue Number Register 2
024Ch
DMAQNUM3
DMA Queue Number Register 3
0250h
DMAQNUM4
DMA Queue Number Register 4
0254h
DMAQNUM5
DMA Queue Number Register 5
0258h
DMAQNUM6
DMA Queue Number Register 6
025Ch
DMAQNUM7
DMA Queue Number Register 7
Copyright
2009–2011, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
93
Product Folder Link(s): TMS320DM365
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| TMX320DM365ZCED21F | 制造商:TI 制造商全称:Texas Instruments 功能描述:Digital Media System-on-Chip (DMSoC) |
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