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参数资料
| 型号： | TMX320F2812ZHHS |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | TMS320R2811, TMS320R2812 Digital Signal Processors |
| 中文描述： | TMS320R2811，TMS320R2812数字信号处理器 |
| 文件页数： | 98/147页 |
| 文件大小： | 2021K |
| 代理商： | TMX320F2812ZHHS |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页当前第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页
Electrical Specifications
98
June 2004
SPRS257
t
w(WAKE-INT)
t
d(WAKE-STBY)
t
d(IDLE
XCOH)
32 SYSCLKOUT Cycles
Wake
up
Signal
X1/XCLKIN
XCLKOUT
STANDBY
Normal Execution
STANDBY
Flushing Pipeline
A
B
C
D
E
F
Device
Status
NOTES: A. IDLE instruction is executed to put the device into STANDBY mode.
B. The PLL block responds to the STANDBY signal. SYSCLKOUT is held for approximately 32 cycles before being turned
off. This 32
cycle delay enables the CPU pipe and any other pending operations to flush properly.
C. The device is now in STANDBY mode.
D. The external wake
up signal is driven active (negative edge triggered shown as an example).
E. After a latency period, the STANDBY mode is exited.
F. Normal operation resumes. The device will respond to the interrupt (if enabled).
Figure 6
11. STANDBY Entry and Exit Timing
Table 6
11. HALT Mode Switching Characteristics
PARAMETER
MIN
TYP
MAX
UNIT
t
d(IDLE-XCOH)
t
w(WAKE-XNMI)
t
w(WAKE-XRS)
t
p
Delay time, IDLE instruction executed to XCLKOUT high
32 * t
c(SCO)
2 * t
c(CI)
8 * t
c(CI)
45 * t
c(SCO)
Cycles
Pulse duration, XNMI wakeup signal
Cycles
Pulse duration, XRS wakeup signal
Cycles
PLL lock-up time
131072 * t
c(CI)
Cycles
t
d(wake)
Delay time, PLL lock to program execution resume
Wake-up from SARAM
35*tc(SCO)
Cycles
A
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PDF描述 |
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