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参数资料
| 型号： | TSPC860SRMZPU50D4 |
| 厂商： | E2V TECHNOLOGIES PLC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 50 MHz, RISC PROCESSOR, PBGA357 |
| 封装： | PLASTIC, BGA-357 |
| 文件页数： | 79/90页 |
| 文件大小： | 2351K |
| 代理商： | TSPC860SRMZPU50D4 |
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80
TSPC860
2129A–HIREL–08/02
Notes:
1. SCL frequency is given by SCL = BrgClk_frequency/((BRG register + 3) * pre_scaler
The ratio SYNCCLK/(BRG_CLK/pre_scaler) must be greater or equal to 4/1.
Figure 72. TWI Bus Timing Diagram
TWI AC Electrical Specifications – SCL > 100 kHz
Num
Characteristic
Expression
Min
Max
Unit
200
SCL Clock Frequency (SLAVE)
fSCL
0
BRGCLK/48
Hz
200
SCL Clock Frequency (MASTER)
fSCL
BRGCLK/16512
BRGCLK/48
Hz
202
Bus Free Time Between Transmissions
1/(2.2 * fSCL)
–
s
203
LOW Period of SCL
1/(2.2 * fSCL)
–
s
204
HIGH Period of SCL
1/(2.2 * fSCL)
–
s
205
START Condition Setup Time
1/(2.2 * fSCL)
–
s
206
START Condition Hold Time
1/(2.2 * fSCL)
–
s
207
DATA Hold Time
0
–
s
208
DATA Setup Time
1/(40 * fSCL)
–
s
209
SDL/SCL Rise Time
–
1/(10 * fSCL)
s
210
SDL/SCL Fall Time
–
1/(33 * fSCL)
s
211
STOP Condition Setup Time
1/(2.2 * fSCL)
–
s
202
SDA
SCL
203
204
205
207
208
209
206
210
211
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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