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参数资料
| 型号： | UPSD3212CV-24U6 |
| 厂商： | 意法半导体 |
| 英文描述： | Flash Programmable System Devices with 8032 MCU with USB and Programmable Logic |
| 中文描述： | 闪存可编程系统设备与8032具有USB和可编程逻辑控制器 |
| 文件页数： | 33/163页 |
| 文件大小： | 2844K |
| 代理商： | UPSD3212CV-24U6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页
33/163
uPSD3212A, uPSD3212C, uPSD3212CV
Note: (Register address = csiop address + address offset; where csiop address is defined by user in PSDsoft)
* indicates bit is not used and need to set to '0.'
21
Output
Macrocells BC
22
Mask Macrocells
AB
23
Mask Macrocells
BC
C0
Primary Flash
Protection
Sec3_
Prot
Sec2_
Prot
Sec1_
Prot
Sec0_
Prot
Bit = 1 sector
is protected
C2
Secondary Flash
Protection
Security
_Bit
*
*
*
*
*
Sec1_
Prot
Sec0_
Prot
Security Bit =
1 device is
secured
B0
PMMR0
*
*
PLD
Mcells
clk
PLD
array-
clk
PLD
Turbo
*
APD
enable
*
00
Control PLD
power
consumption
B4
PMMR2
*
PLD
array
Ale
PLD
array
Cntl2
PLD
array
Cntl1
PLD
array
Cntl0
*
*
00
Blocking
inputs to PLD
array
E0
Page
00
Page Register
E2
VM
Periph-
mode
*
*
FL_
data
Boot_
data
FL_
code
Boot_
code
SR_
code
Configure
8032 Program
and Data
Space
CSIOP
Addr
Offset
Register Name
Bit Register Name
Reset
Value
Comments
7
6
5
4
3
2
1
0
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| UPSD3212CV-40U6T | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:Flash Programmable System Devices with 8032 MCU with USB and Programmable Logic |
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