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参数资料
| 型号： | V54C3128164VBC7PC |
| 厂商： | PROMOS TECHNOLOGIES INC |
| 元件分类： | DRAM |
| 英文描述： | 8M X 16 SYNCHRONOUS DRAM, 5.4 ns, PBGA54 |
| 封装： | MO-210, FBGA-54 |
| 文件页数： | 10/56页 |
| 文件大小： | 734K |
| 代理商： | V54C3128164VBC7PC |
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18
V54C3128(16/80/40)4VB Rev.1.5 March 2006
ProMOS TECHNOLOGIES
V54C3128(16/80/40)4VB
AC Characteristics 1,2, 3
TA = 0 to 70 °C; VSS = 0 V; VDD = 3.3 V ± 0.3 V, tT = 1 ns
#
Symbol
Parameter
Limit Values
Unit Note
-6
-7PC
-7
-8PC
Min. Max. Min. Max. Min. Max. Min. Max.
Clock and Clock Enable
1tCK
Clock Cycle Time
CAS Latency = 3
CAS Latency = 2
6
7.5
–
7
7.5
–
7
10
–
8
10
–
s
ns
2tCK
Clock Frequency
CAS Latency = 3
CAS Latency = 2
–
166
133
–
143
133
–
143
100
–
125
100
MHz
3tAC
Access Time from Clock
CAS Latency = 3
CAS Latency = 2
–
_
5.4
–
_
5.4
–
_
5.4
6
–
_
6
ns
2, 4
4tCH
Clock High Pulse Width
2.5
–
2.5
–
2.5
–
3
–
ns
5tCL
Clock Low Pulse Width
2.5
–
2.5
–
2.5
–
3
–
ns
6tT
Transition Tim
0.3
1.2
0.3
1.2
0.3
1.2
0.5
10
ns
Setup and Hold Times
7tIS
Input Setup Time
1.5
–
1.5
–
1.5
–
2
–
ns
5
8tIH
Input Hold Time
0.8
–
0.8
–
0.8
–
1
–
ns
5
9tCKS
Input Setup Time
1.5
–
1.5
–
1.5
–
2
–
ns
5
10
tCKH
CKE Hold Time
0.8
–
0.8
–
0.8
–
1
–
ns
5
11
tRSC
Mode Register Set-up Time
12
–
14
–
14
–
16
–
ns
12
tSB
Power Down Mode Entry Time
0
6
0
7
0
7
0
8
ns
13
tDS
Data-in setup time
1.5
–
1.5
–
1.5
–
1.5
–
ns
14
tDH
Data-in hold time
0.8
–
0.8
–
0.8
–
0.8
–
ns
Common Parameters
15
tRCD
Row to Column Delay Time
15
–
15
–
15
–
20
–
ns
6
16
tRP
Row Precharge Time
15
–
15
–
15
–
20
–
ns
6
17
tRAS
Row Active Time
40
100K
42
100K
42
100K
45
100k
ns
6
18
tRC
Row Cycle Time
60
–
60
–
60
–
60
–
ns
6
19
tRRD
Activate(a) to Activate(b) Command Period
12
–
14
–
14
–
16
–
ns
6
20
tCCD
CAS(a) to CAS(b) Command Period
1
–
1
–
1
–
1
–
CLK
21
tDPL
Data-in to Precharge Command for Manual
precharge
2–2
–2–
2
–
CLK
Refresh Cycle
22
tREF
Refresh Period (4096 cycles)
—
64
—
64
—
64
—
64
ms
23
tSREX
Self Refresh Exit Time
1
—
1
—
1
—
1
—
CLK
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PDF描述 |
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