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参数资料
| 型号： | V850E1 |
| 厂商： | NEC Corp. |
| 元件分类： | 32位微控制器 |
| 英文描述： | 32-Bit Microprocessor Core |
| 中文描述： | 32位微处理器内核 |
| 文件页数： | 124/226页 |
| 文件大小： | 1709K |
| 代理商： | V850E1 |
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CHAPTER 2 REGISTER SET
User’s Manual U14559EJ3V1UM
21
2.2.4 Program status word (PSW)
The program status word (PSW) is a collection of flags that indicate the status of the program (result of instruction
execution) and the status of the CPU.
If the contents of the bits in this register are modified by the LDSR instruction, the PSW will assume the new value
immediately after the LDSR instruction has been executed. Setting the ID flag to 1, however, will disable interrupt
requests even while the LDSR instruction is being executed.
Bits 31 to 12 and 10 to 8 are reserved for future function expansion (fixed to 0).
Figure 2-6. Program Status Word (PSW) (1/2)
31
87
6
5
4
3
2 1
0
PSW
N
P
S
A
T
E
P
I
D
O
V
SZ
C
Y
Initial value
00000020H
000000
0
000
11
S
9
10
12
Bit Position
Flag Name
Function
11
SS
Note
Operates with single-step execution when this flag is set to 1 (debug trap occurs each time
instruction is executed).
This flag is cleared to 0 when branching to the interrupt servicing routine.
When the SE bit of the DIR register is 0, this flag is not set (fixed to 0).
7
NP
Indicates that non-maskable interrupt (NMI) servicing is in progress. This flag is set to 1
when an NMI request is acknowledged, and multiple interrupt servicing is disabled.
0: NMI servicing is not in progress
1: NMI servicing is in progress
6
EP
Indicates that exception processing is in progress. This flag is set to 1 when an exception
occurs. Even when this bit is set, interrupt requests can be acknowledged.
0: Exception processing is not in progress
1: Exception processing is in progress
5
ID
Indicates whether a maskable interrupt request can be acknowledged.
0: Interrupts enabled (EI)
1: Interrupts disabled (DI)
4
SAT
Note
Indicates that an overflow has occurred in a saturated operation and the result is saturated.
This is a cumulative flag. When the result is saturated, the flag is set to 1 and is not cleared
to 0 even if the next result is not saturated. To clear this flag to 0, use the LDSR instruction.
This flag is neither set to 1 nor cleared to 0 by execution of an arithmetic operation
instruction.
0: Not saturated
1: Saturated
3
CY
Indicates whether a carry or borrow occurred as a result of the operation.
0: Carry or borrow did not occur
1: Carry or borrow occurred
2
OV
Note
Indicates whether overflow occurred as a result of the operation.
0: Overflow did not occur
1: Overflow occurred
Note Can only be used in type A or B products. Cannot be used in other product types.
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PDF描述 |
|---|---|
| V902-FREQ | VCXO, CLOCK, 65 MHz - 200 MHz, LVDS OUTPUT |
| V903-FREQ | VCXO, CLOCK, 200 MHz - 730 MHz, LVDS OUTPUT |
| VB-24STBU | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-5 | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-E | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
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参数描述 |
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