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参数资料
| 型号： | W25Q80BVSNAP |
| 厂商： | WINBOND ELECTRONICS CORP |
| 元件分类： | PROM |
| 英文描述： | 8M X 1 SPI BUS SERIAL EEPROM, PDSO8 |
| 封装： | 0.150 INCH, GREEN, PLASTIC, SOIC-8 |
| 文件页数： | 62/75页 |
| 文件大小： | 1055K |
| 代理商： | W25Q80BVSNAP |
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W25Q80BV
Publication Release Date: October 06, 2010
- 65 -
Revision D
10.6 AC Electrical Characteristics
SPEC
DESCRIPTION
SYMBOL
ALT
MIN
TYP
MAX
UNIT
Clock frequency for all instructions
except Read Data instruction (03h)
2.7V-3.6V VCC & Industrial Temperature
FR
fC
D.C.
80
MHz
Clock frequency for all instructions
except Read Data instruction (03h)
3.0V-3.6V VCC & Industrial Temperature
FR
fC
D.C.
104
MHz
Clock frequency for Read Data instruction (03h)
fR
D.C.
50
MHz
Clock High, Low Time
for all instructions except Read Data (03h)
tCLH1,
tCLL1(1)
4
ns
Clock High, Low Time
for Read Data (03h) instruction
tCRLH,
tCRLL(1)
8
ns
Clock Rise Time peak to peak
tCLCH(2)
0.1
V/ns
Clock Fall Time peak to peak
tCHCL(2)
0.1
V/ns
/CS Active Setup Time relative to CLK
tSLCH
tCSS
5
ns
/CS Not Active Hold Time relative to CLK
tCHSL
5
ns
Data In Setup Time
tDVCH
tDSU
2
ns
Data In Hold Time
tCHDX
tDH
5
ns
/CS Active Hold Time relative to CLK
tCHSH
5
ns
/CS Not Active Setup Time relative to CLK
tSHCH
5
ns
/CS Deselect Time (for Array Read
Array Read)
tSHSL1
tCSH
10
ns
/CS Deselect Time (for Erase or Program
Read
Status Registers)
Volatile Status Register Write Time
tSHSL2
tCSH
50
ns
Output Disable Time
tSHQZ(2)
tDIS
7
ns
Clock Low to Output Valid
2.7V-3.6V / 3.0V-3.6V
tCLQV1
tV1
7/6
ns
Clock Low to Output Valid (for Read ID instructions)
2.7V-3.6V / 3.0V-3.6V
tCLQV2
tV2
8.5/7.5
ns
Output Hold Time
tCLQX
tHO
0
ns
/HOLD Active Setup Time relative to CLK
tHLCH
5
ns
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