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参数资料
| 型号： | WJLXT901ALCA4 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封装： | ROHS COMPLIANT, LQFP-64 |
| 文件页数： | 20/48页 |
| 文件大小： | 621K |
| 代理商： | WJLXT901ALCA4 |
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Intel
LXT901A/907A Universal 3.3 V Ethernet Transceiver
Datasheet
27
Document Number: 249098
Revision Number: 003
Revision Date: 27-Nov-2005
3.4.6
AUI Encoder/Decoder Only
In this application (Figure 15), the DTE is connected to a coaxial network through the AUI.
AUTOSEL is tied Low and PAUI is tied High to manually select the AUI port. The twisted-pair
port is not used. With MD1 and MD0 both Low, the logic and framing are set to Mode 1
(compatible with AMD AM7990 controllers). The LI pin is tied Low, disabling the link test
function. The DSQE pin is also Low, enabling the SQE function on the LXT907A Transceiver. The
LBK input controls loopback. A 20 MHz system clock is supplied at CLK1, with CLK0 left open.
Figure 15. AUI Encoder/Decoder Only Application
LX
T
907
A
TXD
RBIAS
GND2
GND1
TEN
TCLK
RCLK
RXD
CD
COL
LBK
AUTOSEL
NTH
MD0
MD1
DSQE (907A)
LI
JAB
PLR
TX
TENA
TCLK
RCLK
RX
RENA
CLSN
LBK
Red
AM7990 BACK-END/
CONTROLLER
INTERFACE
LOOPBACK
CONTROL
PROGRAMMING
OPTIONS
LINE STATUS
1 %
GREEN
+3.3 V
LEDC/FDE
LEDR
LEDT/PDN
LEDL
VCC1
VCC2
CLKI
330
1
2
4
5
7
89
10
12
13
15
16
1
2
3
4
5
6
7
8
15
14
13
12
9
10
11
+ 12 V
CIN
CIP
DON
DOP
DIN
DIP
D
-
CO
NN
E
C
T
O
R
t
o
AU
ID
R
O
P
C
A
BL
E
Chassis
Gnd
Fuse
78
Ω
78
Ω
78
Ω
12.4 k
Ω
CLKO
PAUI
Bias resistor RBIAS should be
located close to the pin and
isolated from the other signals
20 MHz
Left Open
SYSTEM
CLOCK
TEST
1
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