参数资料
| 型号： | XCV400E-7BG560I |
| 厂商： | Xilinx Inc |
| 文件页数： | 16/233页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V I-TEMP 560-MBGA |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex®-E |
| LAB/CLB数： | 2400 |
| 逻辑元件/单元数： | 10800 |
| RAM 位总计： | 163840 |
| 输入/输出数： | 404 |
| 门数： | 569952 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 560-LBGA，金属 |
| 供应商设备封装： | 560-MBGA（42.5x42.5） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
26
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
2
IO_L41N_Y
H2
2
IO_VREF_L42P_Y
H11
2
IO_L42N_Y
J4
2
IO_VREF_L43P_YY
J2
2
IO_D1_L43N_YY
K4
2
IO_D2_L44P_YY
K2
2
IO_L44N_YY
K1
2
IO_L45P_Y
L2
2
IO_L45N_Y
M4
2
IO_L46P_Y
M3
2
IO_L46N_Y
M2
2
IO_L47P_Y
N4
2
IO_L47N_Y
N3
2
IO_VREF_L48P_YY
N1
2
IO_D3_L48N_YY
P4
2
IO_L49P_Y
P3
2
IO_L49N_Y
P2
2
IO_VREF_L50P_Y
R32
2
IO_L50N_Y
R4
2
IO_L51P_YY
R1
2
IO_L51N_YY
T3
3IO
AA2
3IO
AC2
3IO
AE2
3IO
U3
3IO
W1
3
IO_L52P_Y
U4
3
IO_VREF_L52N_Y
U22
3
IO_L53P_Y
U1
3
IO_L53N_Y
V3
3
IO_D4_L54P_YY
V4
3
IO_VREF_L54N_YY
V2
3
IO_L55P_Y
W3
3
IO_L55N_Y
W4
3
IO_L56P_Y
Y1
Table 12: BG432 — XCV300E, XCV400E, XCV600E
Bank
Pin Description
Pin #
3
IO_L56N_Y
Y3
3
IO_L57P_Y
Y4
3
IO_L57N_Y
Y2
3
IO_L58P_YY
AA3
3
IO_D5_L58N_YY
AB1
3
IO_D6_L59P_YY
AB3
3
IO_VREF_L59N_YY
AB4
3
IO_L60P_Y
AD1
3
IO_VREF_L60N_Y
AC31
3
IO_L61P_Y
AC4
3
IO_L61N_Y
AD2
3
IO_L62P_YY
AD3
3
IO_VREF_L62N_YY
AD4
3
IO_L63P_Y
AF2
3
IO_L63N_Y
AE3
3
IO_L64P
AE4
3
IO_L64N
AG1
3
IO_L65P_Y
AG2
3
IO_VREF_L65N_Y
AF3
3
IO_L66P_Y
AF4
3
IO_L66N_Y
AH1
3
IO_L67P
AH2
3
IO_L67N
AG3
3
IO_D7_L68P_YY
AG4
3
IO_INIT_L68N_YY
AJ2
3IO
T2
4GCK0
AL16
4IO
AH10
4IO
AJ11
4
IO
AK7
4IO
AL12
4IO
AL15
4
IO_L69P_YY
AJ4
4
IO_L69N_YY
AK3
4
IO_L70P_Y
AH5
Table 12: BG432 — XCV300E, XCV400E, XCV600E
Bank
Pin Description
Pin #
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