参数资料
| 型号： | XRT71D04IVTR |
| 厂商： | Exar Corporation |
| 文件页数： | 3/22页 |
| 文件大小： | 0K |
| 描述： | IC JITTER ATTENUATOR 4CH 80TQFP |
| 标准包装： | 1,000 |
| 类型： | * |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 4:3 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 44.736MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3.135 V ~ 5.25 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-LQFP |
| 供应商设备封装： | 80-TQFP（14x14） |
| 包装： | 带卷 (TR) |
á
XRT71D04
4 CHANNEL E3/DS3/STS-1 JITTER ATTENUATOR, STS-1 TO DS3 DESYNCHRONIZER
REV. 1.1.1
10
Microprocessor Serial Interface Timing ( see Figure 4 )
Electrical Characteristics (TA = 25°C, VDD = 3.3 V to 5.0 V ± 5 % unless otherwise specified)
SYMBOL
PARAMETER
MIN
TYP
MAX
UNITS.
t21
CS Low to Rising Edge of SClk Setup Time
50
ns
t22
SClk to CS Hold Time
20
ns
t23
SDI to Rising Edge of SClk Setup Time
50
ns
t24
SDI to Rising Edge of SClk Hold Time
50
ns
t25
SClk “Low” Time
240
ns
t26
SClk “High” Time
240
ns
t27
SClk Period
500
ns
t28
SClk to CS Hold Time
50
ns
t29
CSB “Inactive” Time
250
ns
t30
Falling Edge of SClk to SDO Valid Time
200
ns
t31
Falling Edge of SClk to SDO Invalid Time
100
ns
t32
Falling Edge of SClk, or rising edge of CS to High Z
100
ns
FIGURE 4. TIMING DIAGRAM FOR THE MICROPROCESSOR SERIAL INTERFACE
SDI
R/W
A1
A0
CS
SClk
CS
SClk
SDI
SDO
D0
D1
D2
D7
t22
t21
t23
t24
t25
t26
t27
t28
t29
t30
t31
t32
t33
Hi-Z
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