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参数资料
| 型号： | XRT83SL34 |
| 厂商： | Exar Corporation |
| 英文描述： | QUAD T1/E1/J1 SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR |
| 中文描述： | 上海四的T1/E1/J1收发器时钟恢复和抖动衰减器 |
| 文件页数： | 43/80页 |
| 文件大小： | 856K |
| 代理商： | XRT83SL34 |
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XRT83SL34
QUAD T1/E1/J1 SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
REV. P1.0.8
PRELIMINARY
45
MICROPROCESSOR REGISTER DESCRIPTIONS
TABLE 19: MICROPROCESSOR REGISTER #0, BIT DESCRIPTION
REGISTER ADDRESS
0000000
0010000
0100000
0110000
CHANNEL_n
CHANNEL_0
CHANNEL_1
CHANNEL_2
CHANNEL_3
FUNCTION
REGISTER
TYPE
RESET
VALUE
BIT #NAME
D7
Reserved
R/W
0
D6
Reserved
R/W
D5
RXON_n
Receiver ON: Writing a “1” into this bit location turns on the
Receive Section of channel n. Writing a “0” shuts off the
Receiver Section of channel n.
NOTES:
1.
This bit provides independent turn-off or turn-on
control of each receiver channel.
2.
In Hardware mode all receiver channels are always
on.
R/W
0
D4
EQC4_n
Equalizer Control bit 4: This bit together with EQC[3:0] are
used for controlling transmit pulse shaping, transmit line build-
out (LBO) and receive monitoring for either T1 or E1 Modes of
operation.
See
Table 5 for description of Equalizer Control bits.
R/W
0
D3
EQC3_n
Equalizer Control bit 3: See bit D4 description for function of
this bit
R/W
0
D2
EQC2_n
Equalizer Control bit 2: See bit D4 description for function of
this bit
R/W
0
D1
EQC1_n
Equalizer Control bit 1: See bit D4 description for function of
this bit
R/W
0
D0
EQC0_n
Equalizer Control bit 0: See bit D4 description for function of
this bit
R/W
0
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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